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基于FPGA的多路数据光纤传输系统设计与实现 总被引:1,自引:0,他引:1
针对某型作战指挥系统中通信网络的传输信号多样性和复杂性,以及信道利用率低的现状,提出了以1310nm/1550nm光纤作为传输媒介,基十FPGA的多路、多速率模拟/数字信息综合传输的设计方案;采用了多种复用技术将不同种类的信号进行处理,复用到单根光纤上传输,以QuartusII 4.0为编译环境,以VHDL语言为开发工具实现了CMI和HDB3编译码;实验结果表明:系统语音信号清晰,数字信号传输误码率低.工作性能稳定;这说明基于FPGA的多路数据光纤传输系统设计是成功的. 相似文献
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时分复用多路光纤传输在飞控系统中的应用 总被引:4,自引:0,他引:4
结合飞控系统的实际情况,研究了光传操纵系统关键技术之一的时分复用多路传输技术,设计并实现一种可应用于飞控系统的时分复用多路光纤传输系统。给出了该系统的主要性能测试结果,并应用于飞控系统半实物仿真。仿真结果表明,该多路光纤传输系统应用于飞控系统是完全可行的。 相似文献
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高速多路实时数据采集处理系统设计 总被引:6,自引:1,他引:5
介绍了以(PLD)为核心处理芯片的多路数据采集系统的实现方法。该系统通过高速状态机直接将采样数据储存到高速缓冲SRAM阵列中,然后再转存至低速存储器(SDRAM)中,再由CPLD构成的滤波器进行数据处理,整个系统由CPLD和单片微控制器进行联合控制。采用3块TI公司的8位80MSPS的高速单流水线A/D芯片TLV5580采集数据,通过延迟流水采样技术可实现对24路通道,最高采样率为240MHz的模拟信号的采集和处理;采用ALTERA公司的CPLD芯片EPF10K10AFC256-1实现数据处理。通过仿真和调试运行,验证了复杂的数据处理过程被大大简化了,整个系统高速、紧凑,具有良好的抗干扰性。 相似文献
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基于FPGA的主从式高速数据采集与传输系统 总被引:1,自引:0,他引:1
针对数据采集系统有信号形式多样、实时传输和灵活配置的要求,介绍了一种基于FPGA的数据采集和传输系统,以及系统数字电路的程序设计.该系统以现场可编程逻辑阵列(FPGA)作为数据采集、预处理、组帧和传输的控制核心,通过低速串口接收控制命令,以高速USB接口向控制台发送采集数据帧,设计了数字FIR滤波器滤除采集电路的信号干... 相似文献
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基于雷达信号的高速数据采集系统的设计 总被引:2,自引:0,他引:2
本文介绍了一种基于雷达信号的高速数据采集的方法,从系统的硬件设计,电路实现以及它的工作时序几个方面来说明了系统是如何进行工作的。文章从系统的要求出发介绍了整个系统的总体的设计方案及其原理,并详细描述了FPGA的配置过程。 相似文献
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基于USB2.0技术的高速双路数据采集系统 总被引:1,自引:0,他引:1
本文设计了一种基于USB2.0芯片CY7C68013和Maxim公司的高速并行模数转换芯片Max1195的高速双路数据采集系统,采用EZ-USB FX2的特有的GPIF(General Programmable Interface)传输方式,彻底打破了8051CPU对USB2.0传输速率的瓶颈,同时避免了使用其他微处理器或者CPLD、FPGA等的硬件开支.本文详细介绍了该数据采集系统的硬件组成和软件设计,包括单片机CY7C68013的固件设计和计算机主机用户程序.通过与高精度激光纵模分析仪的连接调试,证明该系统已经达到了既定目标. 相似文献
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针对复杂战场环境对数据采集的需求,利用FPGA构建了可编程片上系统(SOPC),实现了高速多路数据采集,详细论述了NIOSII嵌入式系统以及其外设的设计方法;传感器采集的数据经过高速AD转换后,由SOPC系统进行数据缓冲和格式转换并存入存储器,SD卡的使用方便了数据的存取、处理和存储空间的扩展;实验结果表明,该系统能够可靠、准确地对多路信号进行采集,且运行稳定. 相似文献
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本文提出了一种基于声卡的高速数据采集系统,讨论了使用DirectX 8的软件实现技术以及应用实例,这样的数据采集系统无需开发硬件,最高可达到双路16位(bit),44.1K/秒采样率,可移植性好,有较广的适应面。 相似文献
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针对移动场合中多数据源的数据采集问题,综合考虑多数据源的带宽需求和元器件性价比等因素,提出一种基于时分复用技术的多源数据采集系统设计方案。根据采集系统内数据总线挂载多个 USB HOST 控制芯片的结构特点,提出一种数据传输的直传方法,数据包可不经过MCU的缓存,直接从数据信息设备传输至数据存储设备,提高系统数据传输的速率。仿真结果表明,数据设备中的数据能正确高效地传输至存储设备中。 相似文献
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基于FPGA的低成本长距离高速传输系统的设计与实现 总被引:1,自引:1,他引:0
借助Altera CycloneⅢFPGA的LVDS I/O通道产生LVDS信号,稳定地完成了数据的高速、远距离传输。系统所需的8B/10B编解码、数据时钟恢复(CDR)、串/并行转换电路、误码率计算模块均在FPGA内利用VHDL语言设计实现,大大降低了系统互联的复杂度和成本,提高了系统集成度和稳定性。 相似文献
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