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基于FPGA的高速AD采样设计 总被引:2,自引:0,他引:2
随着雷达技术及现代宽带通信技术的发展,高速ADC在数字化宽带接收器的设计中起了重要作用。本文提出基于FPGA的高速AD采样设计,给出了基于FPGA的高速采样时钟设计方案以及FPGA对时钟芯片AD9516_4与ADC的配置设置,并对采样结果有效位数进行测定。结果证明该设计灵活、简单、通用性强。 相似文献
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介绍了基于FPGA的高速数据采集系统,系统的控制时序、逻辑信号以及对所采集数据的存储均用FPGA来实现。为了达到高速采样的目的,系统搭建了基于USB2.0的接口,由FPGA与芯片CY7C68013实现。介绍了数据采集系统的硬件电路、USB硬件设计以及驱动程序设计。该系统研发周期短,可移植性强。 相似文献
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利用FPGA的DSP开发工具DSP Builder对基本DDFS(直接数字频率合成)建模,并由该DDFS模块实现正交信号发生器,同时用ModelSim和QuartusⅡ进行正交信号的功能仿真时序仿真,仿真结果表明该正交信号频率及相位可灵活调整且分辨率高,能够实现频率及相位的快速切换。 相似文献
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被探测目标的电子战能力严重影响对空雷达的检测和识别性能。针对对空雷达抗干扰问题,提出基于强化学习的抗干扰波形设计方法。从博弈角度利用强化学习方法建立雷达和目标干扰间动态对抗模型,计算博弈各方状态、动作价值,利用策略迭代法生成最优策略,基于相位迭代法合成时域波形。仿真结果表明:使用新方法设计的雷达发射信号时,与线性调频信号、捷变频信号相比,信干噪比分别提高了6.39 dB和1.12 dB;信号总功率为11 W时,与捷变频信号相比,目标检测概率提升了5%,可在低功率实现抗干扰的同时提升雷达信号抗截获性能。 相似文献
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利用FPGA的有效资源,设计了无线电修正单元信号编码控制系统,并完成与上位机的串口通讯,产生微波单元及副载频调制板需要的控制信号,同时将自检测、点频号、帧号以及衰减信号等信息实时显示到LCD显示屏上,使系统具有良好的人机界面。 相似文献
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信号完整性(SI)是高速电路设计面临的一个主要问题。对109 Hz以上高速信号的信号完整性问题从原理上进行了详细分析,并针对损耗、串扰、反射等因素提出了改善信号完整性的方法。在高速串行RapidIO总线背板的设计中,探索出一套利用HyperLynx工具进行仿真分析和设计验证的方法,即利用前仿真工具LineSim对影响信号完整性的主要参数进行评估,形成设计指导数据;利用后仿真工具BoardSim对布线后的高速背板进行验证,从理论上证明了高速串行RapidIO总线背板的设计是可行的。 相似文献
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当前CAN总线与串口通信接口转换均采用单片机,有效转换速率很低,不能满足条件苛刻的场合;采用CPLD/FPGA进行协议直接转换的方案,能极大地提高系统的有效转换速率;为进一步提高系统的可靠性,采用CAN总线驱动器热冗余技术;通过CPLD/FPGA将CAN总线控制器的内部寄存器直接映像到PC104总线I/O上,解决了I/O映像或双口RAM速率较低、电路复杂的缺点.以RS485型串口为例,它的有效转换速率在同等情况下是传统产品的2~3倍,实时性和可靠性明显得到改善. 相似文献
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针对便携式、小型化与低功耗的需求,采用可编程逻辑器件FPGA 作为主控制器,设计一款便携式双通
道信号源。采用CORDIC 算法实现DDS 正弦信号的产生,输出2 路幅频相连续可调的正弦信号;利用智能触控屏
设计信号源的人机交互接口,对信号源参数进行配置与实时显示;触控屏与FPGA 之间采用Modbus RTU 协议进行
通信。实际测试结果表明:该信号源输出的正弦信号频率稳定性好,相位、幅值调节准确性好,能够满足测试设备
的需求。 相似文献
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为降低交通事故的发生率,设计一种基于现场可编辑门阵列的雷达后端电路方案。阐述雷达后端电路主
要实现的功能,对雷达后端电路进行分解,对信号采集电路、FPGA 电路、电源电路、DDS 电路进行分析,实现毫
米波雷达后端数字处理板的设计,并通过车辆进行外场测试。测试结果表明:该系统能够改善雷达探测的实时性,
保障驾驶员的行驶安全。 相似文献
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