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针对随机扫描数字式图形显示终端,分析了传统雷达图像传输方法优缺点,提出利用视频—时基压缩技术较大幅度降低编码速率方法,在此基础上,对图像传输码速率进行了调理。并改变传统的双存储器实现视频—时基压缩电路方法,设计实现了一种基于单存储器的视频—时基压缩电路,既能传输雷达图像又能传输大量二次信息的全数字情报传输系统,实际应用效果好。 相似文献
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基于FPGA的SDRAM控制器设计 总被引:7,自引:0,他引:7
SDRAM是一种大容量、高速度的动态存储器,在电子设计领域应用很广泛。本文介绍了在雷达光栅显示系统中,应用SDRAM作为视频存储器时,采用FPGA实现控制电路的过程. 相似文献
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介绍了嵌入式雷达视频服务器的原理、软硬件设计及其实现。在硬件设计上,将高速数字信号处理器应用于雷达视频压缩处理。解决了高速信息交换、实时压缩处理等关键技术问题;在压缩算法上,详细研究了雷达视频信号的特点并设计了专用压缩方法。该系统具有通用化、模块化和可编程能力强的特点,能够满足实时显示和录取的要求。 相似文献
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基于Camera接口的船用导航雷达显示设计 总被引:1,自引:0,他引:1
介绍了基于ARM的Camera接口船用导航雷达显示设计。通过FPGA将雷达回波转换成ITU—RBT601/656视频信号,将视频信号送入ARM的Camera接口,存贮在帧缓存存储器,ARM的显示控制器以DMA的方式读取帧缓存数据,与人机界面在显示控制内部混合叠加后直接送显示器显示。该设计实现了雷达的回波和人机界面的同步显示。满足了船用导航雷达系统的显示要求,并在工程上验证了该设计的有效性。 相似文献
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为了实现对视频进行捕获后压缩,文中提出一种基于DM368的视频捕获压缩方案,并设计完成相应的硬件与软件.该系统主要使用TI达芬奇DM368片上系统作为主控芯片,采用TVP5158作为视频采集前端.采用1G容量的DDR2内存作为易失性存储器.采用1GFlash作为系统内核与文件系统的存储介质.软件部分在Linux平台中使用达芬奇DVSDK进行编程.压缩规格上使用目前较为流行的MPEG4算法.从而实现视频的捕获与压缩.经实际测试显示,使用该平台进行视频捕获压缩开发较以往DSP和FPGA方案更加成熟稳定,并可以通过TI的开发工具和现有软件库大大减少开发周期. 相似文献
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用TMS320C50DSP实现图像的直接捕获与显示 总被引:3,自引:0,他引:3
大多数视频捕获系统都要有专门的控制电路,用来把来自视频模/数转换器(ADC)的数据传输给系统存储器或把数据由系统存储器传输给视频数/模转换器(DAC).这个控制电路是复杂的.本文说明了数字信号处理器(DSP)如何能简化视频捕获和显示系统的设计,这是靠DSP由ADC读取数据写入系统存储器或由存储器读取数据写入DAC来实现的.本文给出了使用TMS320C50DSP实现这样的系统的例子。C50最高可运行在28.6MHZ上,可以做到每行捕获1485个采样.当系统以低分辨捕获和显示视频时可以做到边捕获边显示,边捕获边处理或边显示边处理,可以解决许多技术问题. 相似文献
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一次模拟视频的数字处理与显示以及一、二次信息混合与同步,是实现光栅扫描雷达显示器的两个基本的关键技术。针对某雷达光栅扫描引导显示器的设计要求,具体讨论了信号预处理(压缩和积累),余辉显示与控制,一、二次信息的混合显示等有关问题及其解决方案。这些技术均在引导显示器的研制中获得了成功应用,并取得了满意的效果。 相似文献
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2.时基校正器时基校正是一个如图6所示的环形结构的溢出存储器。其作用是用来吸收系统读出信息中,由唱片偏心率及卡紧公差等因素所引起的抖动。除此之外,还可从分析时基校正器的地址关系中提取CLV误差信号。 相似文献
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针对航测高分辨率CCD巨量压缩视频数据的存取,提出了一种基于文件结构的快速存取系统方案,并给出了该方案在实际存储器中的实现结构。该存取系统主要由图像基本信息和详细信息组成。图像基本信息包括帧号、缩略图、编码长度和地址。通过图像帧号获得图像的基本信息,实现快速浏览;并可进一步读取任意帧图像的详细编码信息。同时,构造了基于小波变换的缩略图方法,并通过对相关存取结构的设计,给出了整个存取系统在存储器中的实现。通过对该系统的研究实现,可高效快捷的实现对任意帧图像数据的快速存取和查找,大大提高了工作效率。 相似文献
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5.视频编码器的实现方案 一个完整的视频编码器由视频信号处理器(VSP)、视频控制器、视频输入接口、视频输出接口(显示)、外部存储器接口(包括程序存储器接口和图象数据存储器接口),以及具有层次结构的存储器系统等几部分构成. 相似文献
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利用雷达视频信号特点,对游程编码算法进行了分析和改进,提出一种实现相对简单、压缩效果显著的雷达视频信号压缩算法,给出了该算法的VC++实现要点。试验证明该方法能满足雷达视频准实时远程传送系统的回放要求。 相似文献
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线性调频脉冲压缩雷达视频回波模型 总被引:1,自引:1,他引:0
对于线性调频脉冲压缩雷达视频回波的模拟,目前使用方法最多的是硬件实现,即根据中频回波模型获得中频回波后,依次通过硬件实现的匹配滤波器等接收部件获得视频回波。若用软件实现这一流程,则由于卷积、相关等运算导致效率极低。推导出了脉冲压缩后的雷达视频回波模型,可以直接根据该模型获得视频回波,减少了运算量,提高了效率,使软件实现实时脉冲压缩雷达视频回波模拟成为可能。最后还对该模型进行了仿真分析,验证了该模型的正确性和实用性。 相似文献
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根据雷达视频数据量大、目标信息较为重要的特点,设计并实现了一种基于FPGA的高分辨率雷达视频压缩方案。该方案针对压缩过程中算法较为复杂,且有大量浮点运算、乘法处理等高计算复杂度的问题,对DCT、量化、编码等核心处理模块分别进行了优化设计。在一片Stratix ⅣGX EP4SGX230KF40C4芯片上进行了验证,结果表明,该设计方案资源占用率低,压缩后图像质量较好,对于1600x1200分辨率的视频处理速度可达50帧/秒以上,满足高分辨率雷达视频实时压缩的要求。 相似文献
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