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介绍了基于四相单轨握手协议的异步FIR滤波器接口电路的设计。分析了异步接口电路互联模型及原理,提出了一种基于存储器和状态机实现异步握手接口电路的全新方案,实现了FIR滤波器功能和异步接口控制功能。对设计进行了波形仿真及结果分析,验证了设计方案的可行性。 相似文献
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以往异步电路在FPGA上的设计验证采用HDL设计的Muller门搭建电路,在实现时需要手动布局布线来完成时序约束,设计繁琐复杂.对此完善了异步电路设计平台Balsa与FPGA设计工具相结合的设计验证流程,采用四相双轨延迟不敏感的握手协议,避免了手动布局布线的繁琐步骤.同时,在不同FPGA平台间具有良好的可移植性.重点设计了遵循异步握手协议的输入电路,完成了行为级到板级的全流程设计及验证. 相似文献
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研究了异步FIFO状态判断的问题,提出了一种能快速准确判断异步FIFO空、满和半满状态的方案,设计了状态判断的逻辑电路并给出了物理实现。 相似文献
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<正> 单相异步电动机的变频调速因为其有广泛的应用范围,一直是人们特别关心的问题。单相异步电动机变频调速专用的集成电路由于价格等问题一直不能普及。所以,研究一种采用通用廉价集成电路的变频调速装置是很有必要的。这里介绍一种单相异步电动机变频调速电路,其框图如图1所示。 相似文献
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本文以异步流水乘法器的设计为例,介绍了利用FPGA进行异步电路设计的思路及方法。本设计采用两段握手协议实现异步流水乘法器,将其分解为三个核心模块:信号分支模块、异步移位模块和异步加法器模块。本文具体说明了利用硬件描述语言实现异步乘法器的方法和步骤,通过Modelsim软件进行功能仿真,并下载到Genesys板卡上进行系统测试。该教学方案有助于学生理解并掌握异步电路设计方法。 相似文献
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EPON网是基于千兆以太网的无源光网络技术,是光纤接入网的重要解决方案之一,具有良好的市场发展空间。随着广电网络技术的发展,信息安全的重要性日益增加,加密技术也越来越受到关注。AES算法作为现在的主流加密手段,是密码学中的高级加密标准,对它进行学习和运用具有十分重要的现实意义。讨论EPON系统下行传输存在的安全问题,并简单介绍高级加密算法(AES)在EPON系统内的实现方式,其中主要涉及AES原理的分析以及AES算法的硬件实现和功能仿真。 相似文献
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本文围绕单处理器的微机系统作为异步通讯终端进行并行处理的困难,提出采用双微处理器技术的解决方法,分析了双微处理器系统共享存储器的连接方式。介绍了TMS9650接口芯片的逻辑结构。在提供了完整的独立微处理器异步通讯电路的同时,对其主要技术环节给予了说明。 相似文献
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基于时钟设计的异步时序逻辑电路设计法 总被引:1,自引:1,他引:0
基于时钟设计的异步时序逻辑电路设计法,根据电路状态转换规律,立足电路中各位触发器时钟设计,使电路完成所要求的逻辑功能,从而避免了求解电路状态方程,驱动方程。 相似文献
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针对异步电路设计工具问题,提出了一种基于Balsa和Xilinx FP(iA的全异步设计流程.采用Balsa语言描述异步设计产生网表,导入网表在Xilinx下生成可配置文件,达到板级验证并进行布局布线后仿真分析,在完成异步电路设计的同时采用同步EDA工具验证,以实现异步设计与同步软件的结合,最后通过八位异步全加器设计实例验证该异步设计流程的可行性. 相似文献
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基于PLC的电机基本控制电路设计 总被引:1,自引:0,他引:1
主要讲述了PLC的基本知识以及基于PLC技术的电机三相异步正反转控制电路的设计,设计通过改变三相电源相序,实现了电动机的正反转控制,但自动化程序不高,控制中仍存在需要改进的地方。 相似文献
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首先对异步时序逻辑电路的特点和分类进行描述,接着从具体的操作步骤、结果的表现方式等方面结合具体实例阐述其一般的分析方法和新出现的分析方法:计算分析法和卡诺图分析法,并对计算分析法进行改进,以期能够更好地指导异步时序电路的分析。通过实例分别阐述3种分析方法,并进行对比,在保证分析结果的前提下,改进的计算分析法分析异步时序逻辑电路时不用考虑时钟信号,使分析变得简单;而卡诺图分析法使分析过程思路清晰,状态转换更加直观化。 相似文献
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基于Matlab的异步电动机工作特性的研究 总被引:3,自引:0,他引:3
高仕红 《电气电子教学学报》2010,32(4):40-42,54
中小型异步电动机的工作特性一般采用直接负载法进行测定,但对大型异步电动机在制造厂或现场进行负载实验都比较困难。工程上我们通常用异步电动机的等效电路,采用试探法算出其工作特性和运行数据。本文利用异步电动机的较准确Γ型等效电路,提出其工作特性的解析计算公式。经过验证,在额定工况下利用解析公式得到的计算值与电机的设计值非常接近,可以满足工程实际的需要。另外,利用Matlab软件,可非常方便地作出三相异步电动机的工作特性曲线。 相似文献
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基于VHDL的异步FIFO设计 总被引:1,自引:0,他引:1
FIFO经常应用于从一个时钟域传输数据到另一个异步时钟域。为解决异步FIFO设计过程中空满标志判断难以及FPGA亚稳态的问题,提出一种新颖的设计方案,即利用格雷码计数器(每次时钟到来仅有1位发生改变)表示读/写指针,设计二级同步链为跨越不同时钟域的读/写指针,以提供充足的稳定时间,并通过对比格雷码指针产生空满标志位。该设计采用VHDL语言进行设计,利用ALTERA公司的FPGA得以实现。经验证进一步表明,模块化的设计不仅避免了亚稳态的产生,增大平均无故障工作时间(MBTF),也使工作效率大为提升。 相似文献
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IMS业务部署面临着防火墙穿越的问题,本文对IMS网络防火墙穿越STG实现方案进行了深入剖析,并针对运营商现阶段网络条件对STG功能的部署方式提出了建议 相似文献