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揭示了降维卡诺图的规律。通过实例介绍了用一阶降维卡诺图表示和化简逻辑函数的方法和应用。由于卡诺图的规模大大减少,从而有效地拓展了卡诺图的使用范围。 相似文献
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定义了两种不同性质的约束项,即“不会出现的”约束项和“具任意性”的约束项,并以一个同步五进制加法计数器为例,说明了分别应用这两种最小项以不同的方式设计电路,使所设计的数字电路最简单。最后,以一个能自启动的4位扭环形计数器的设计为例,说明了具体分析、合理应用约束项,避免产生新的无效循环,从而使所设计的4位扭环形计数器电路最简单且能自启动。 相似文献
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基于数字逻辑函数中最小项相邻性原则,将卡诺图进行区域划分定位,从而使得逻辑函数的卡诺图的正确填入更直观简便。而后介绍分析卡诺图在奇异逻辑函数、复合逻辑函数、输入无反变量逻辑电路化简时的几个非常规的应用,得到相应逻辑函数卡诺图化简的简便方法。 相似文献
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多变量卡诺图逻辑相邻的确定 总被引:1,自引:0,他引:1
卡诺图化简仅适用于四个及四个变量以下的逻辑函数的化简。提出了多变量卡诺图化简的两种方法:对称法和卡诺图变换法。解决了多变量卡诺图判断逻辑相邻问题,完善了数字电子技术中卡诺图化简的相关理论。 相似文献
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本文通过实例说明逻辑卡诺图在设计多输出组合逻辑电路中的作用.旨在介绍逻辑卡诺图之间的相互关系,以提高广大读者用逻辑卡诺图化简逻辑函数的能力以及设计多输出组合逻辑电路的能力. 相似文献
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如何利用卡诺图快速准确地化简逻辑函数张兰群(南京航运学校电子教研组,南京,210011)众所周知,化简逻辑函数可以利用逻辑代数的公式和定理。但是,对于一个较复杂的逻辑函数,有时不易看出该用什么样的逻辑代数的公式和定理,即使化简出来,也要费九牛二虎之力... 相似文献
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卡诺图是组合逻辑电路设计和分析常用和有效的数学工具,既可以化简逻辑函数,也可以分析组合逻辑电路的竞争冒险。对于多输入变量的逻辑函数,要排列其卡诺图则不是易事。格雷码的相邻码之间只有1位不同,这与卡诺图的循环邻接有相同之处,因而可以利用格雷码快速排列多变量卡诺图。首先介绍二进制码转化为格雷码的方法并用C语言编程实现其码制转换,接着叙述用格雷码规律快速排列多变量卡诺图的方法,最后举例说明卡诺图在组合逻辑电路竞争冒险中的应用。 相似文献
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卡诺图在化简最简逻辑式中的应用 总被引:1,自引:0,他引:1
介绍利用卡诺图中的最小项和最大项的相邻性、对称性将逻辑表达式化简为所需要的最简表达式的理论基础,并举一有代表性的逻辑式,对其进行化简最筒逻辑式,得出化简为所需的最简逻辑式的结论。 相似文献
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LI Zhi-zhong QIU Shui-sheng 《中国电子科技》2005,3(3):249-252
Discrete-time chaotic circuit implementations of a tent map and a Bernoulli map using switched-current (SI) techniques are presented. The two circuits can be constructed with 16 MOSFET's and 2 capacitors. The simulations and experiments built with commercially available IC's for the circuits have demonstrated the validity of the circuit designs. The experiment results also indicate that the proposed circuits are integrable by a standard CMOS technology. The implementations are useful for studies and applications of chaos. 相似文献
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指出了电类专业的学生,应该熟悉掌握VHDL语言,探讨了把硬件描述语言引入数字电路教学首先要向学生介绍VHDL语言设计的基本内容,然后要求学生完成一个VHDL语言的综合设计。实践表明,这种方法有助于克服学习VHDL语言中的一些难点。 相似文献
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6 实例分析6.1 BCD——十进制译码驱动器(7445)图27是它的逻辑图形符号。图中“BCD/DEC■”是总限定符号,前部表示 相似文献
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数据选择器在数字电路中的应用 总被引:3,自引:0,他引:3
数据选择器作为数字电路中的组合逻辑主要集成元件之一,除了具有传统的数据传输和分配功能之外,还可用作逻辑函数发生器。以中规模集成数据选择器74LS157和74HC151为例,通过3个实例详细介绍以上2种功能,更好地理解和扩展集成器件的性能和用途,达到举一反三、灵活运用的目的。同时,使用数据选择器和译码器在实现组合逻辑函数功能方面也越来越受到重视。 相似文献
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Integrated Circuits of Map Chaos Generators 总被引:1,自引:0,他引:1
Hidetoshi Tanaka Shigeo Sato Koji Nakajima 《Analog Integrated Circuits and Signal Processing》2000,25(3):329-335
A chaotic noise is one of the most important implements for information processing such as neural networks. It has been suggested that chaotic neural networks have high performance ability for information processing. In this paper, we report two designs of a compact chaotic noise generator for large integration circuits using CMOS technology. The chaotic noise is generated using map chaos. We design both of the logistic map type and the tent map type circuits. These chaotic noise generators are compact as compared with the other circuits. The results show that the successful chaotic operations of the circuits because of the positive Lyapunov number. We calculate the Lyapunov exponents to certify the results of the chaotic operations. However, it is hard to estimate its accurate number for noisy data using the conventional method. And hence, we propose the modified calculation of the Lyapunov exponent for noisy data. These two circuits are expected to be utilized for various applications. 相似文献