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采用了锁相环(PLL)结合直接数字频率合成(DDS)的方法实现L波段小步进频率合成器,分析了此种频率合成器的相位噪声和杂散指标。介绍了具体的电路设计过程。实验测试表明,实现的L波段频率合成器结合了锁相环式和直接数字式频率合成的优点,步进间隔1 kHz,相位噪声在10 kHz处可达-98 dBc/Hz,杂散抑制-70 dBc,具有相噪低、杂散抑制好、步进小等特点。 相似文献
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一种L波段的小步进频率合成器 总被引:1,自引:1,他引:1
详细分析了直接数字合成(DDS)和锁相环(PLL)的基本原理、特点及相位噪声特性。将DDS与PLL技术结合,取长补短,可以在不降低杂散性能要求的前提下实现小步进的频率合成器。在此基础上提出了一种DDS+PLL+混频的L波段小步进频率合成器的实现方案。根据方案,选择DDS芯片AD9850和PLL芯片ADF4112来搭建电路。给出了试验测试结果。测试结果表明,在L波段实现了相位噪声-94dBc/Hz@1kHz,杂散抑制-60dBc,频率步进1kHz,验证了该方案的可行性。 相似文献
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提出了一种Ka波段低杂散、捷变频频率合成器设计方案.该方案采用直接数字合成(DDS)+直接上变频的频率合成模式,DDS1产生360~600 MHz低杂散中频信号,DDS2产生波形信号.经过4次上变频、分段滤波、放大后,该方案实现了宽带、低杂散、捷变频频率合成器的设计,为系统提供本振信号、激励信号等.根据设计方案,制作了... 相似文献
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在微波频段,为了实现小步进、低相噪的宽带频率合成器,常采用直接数字合成(DDS)激励锁相环(PLL)的方式,但要同时实现低杂散(特别是近端杂散)则相对困难。本文基于 DDS 低杂散技术进行了研究,并介绍一种改进的基于 DDS激励 PLL技术实现的宽带频率合成器,可有效改善杂散抑制指标。设计所得到频率合成器频率范围为4 GHz~8 GHz,步进为100 kHz,杂散抑制指标可以满足全频段≤-70 dBc。 相似文献
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波形可控的宽带低杂散X波段DDS信号产生器 总被引:1,自引:1,他引:0
介绍了ADI公司的高性能直接数字频率合成器(DDS)芯片AD9858,并利用它构成一种波形可控的宽带低杂散X波段信号产生器。 相似文献
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介绍了一种小频率步进的直接频率合成器的设计方法。给出了频率合成器的设计框图和相关指标测试曲线,包括输出信号频谱图、跳频时间测试曲线和相位噪声测试曲线。该频率合成器突破了一般直接频率合成器频率步进受滤波器件的限制,通过相关电路的设计实现了S波段1MHz频率步进,具有大带宽、小步进、低杂散、低相位噪声和快速变频等优点。 相似文献
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为了对抗有源干扰,雷达系统要求频率合成器具有频率捷变功能;同时要求其杂散抑制越高越好,特别是在输出信号带宽较宽的情况下更是如此。受体积和成本的限制,目前的捷变频频率合成器广泛采用基于直接数字合成(DDS)技术的变频方法。本文基于低杂散,对采用DDS的捷变频频率合成器技术进行了研究,并介绍一种采用时钟频率高达3.2GHz的新型DDS集成电路的低杂散捷变频频率合成器的设计与实现方法,设计得到的捷变频频率合成器带宽为250MHz,其杂散抑制指标可满足全频段优于-65dBc。 相似文献
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直接数字频率合成器的频谱特性的分析 总被引:2,自引:0,他引:2
现代通信系统对合成源的技术指标提出了越来越高的要求,可变参考源驱动的锁相频率合成器是一种较好的解决方案。直接数字频率合成器(DDFS)作为可变参考源是比较理想的。本文对直接数字频率合成器(DDFS)的输出特性进行了讨论,并用傅里叶变换的方法对直接数字频率合成器(DDFS)的输出频谱的杂散进行了分析,得到了有相位舍位民政部下直接数字频率俣成器的杂散分布。 相似文献
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基于高速DDS芯片的宽带低杂散信号产生器的设计与实现 总被引:3,自引:0,他引:3
介绍了在现代雷达接收领域中的一种高性能信号产生器的设计方法。利用高性能直接数字频率合成器(DDS)芯片及单片机构成频率、幅度及相位可控的宽带低杂散信号产生器。实验证明该设计应用于雷达系统中的可行性。 相似文献
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小步进频率合成器的设计 总被引:1,自引:0,他引:1
回顾了三种基本的小步进频率合成器设计方法的优缺点。介绍了一种特殊的小步进频率合成器的设计方法,即采用两个大步进频率的单环锁相电路混频,两者步进频率的差较小为r,就能获得输出为小步进频率(为r)的合成器,并给出了相应的理论依据和计算。只要合理设置频率,规避互调分量的影响,就能使合成信号保持大步进频率单环锁相电路较低相位噪声、较短跳频时间和较低杂散信号的特性,而且合成原理简单,几乎不需要电路调试。 相似文献
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介绍了一种高性能直接数字合成(DDS)芯片的工作原理及特点,并给出了基于DDS设计快速频率源的方案,该频率源具有低相噪、低杂散、细步进、高速频率切换的特点。 相似文献
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