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介绍了一种工作在S波段,全数字分频锁相调频振荡源的电路构成方案、工作原理、设计方法和实验结果。该调频振荡源电路结构简单,调试容易,工作稳定性好,在再入遥测发射设备中有较大的实用价值。 相似文献
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分频锁相单元电路的基本工作原理及故障处理扬州电视台钱毅我台市县微波网所用的西安微波设备厂生产的WSF7-13型收发信机,其发信本振源采用了分频锁相技术,本文结合实际故障的处理,说明它的基本工作原理。分频锁相单元电路从功能上可分为四个部分:(1)电源部... 相似文献
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本文介绍锁相环集成电路NE/SE564的内部结构、引脚、电路特性,技术参数,给出12倍频锁相倍频器的实用电路。 相似文献
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针对“5kW光伏并网逆变器”实际项目中的锁相及保护电路.分析了光伏逆变器在硬件锁相和硬件保护等方面的需求,给出了基于CPLD的数字锁相技术和保护电路的理论原理,以及模块设计与实现方法。 相似文献
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设计了一种用于无绳电话的锁相频率合成器,可以基于BiCMOS工艺与高频接收模拟电路实现单片集成。着重讨论了鉴频/监督相器的原理、死区、最大频率限制及其输出电路。给出了硬件实现的具体线路图,并对模拟结果进行了讨论。 相似文献
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本文分析了INMARSAT船站中一种典型的调制解调电路的组成及共工作原理,、该船站的调制采用相位选择的模拟锁相技术, 相似文献
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SDH通用定时再生电路研究(上) 总被引:1,自引:0,他引:1
本文提出了一种用PLL-VCPS作定时再生电路的新方法,即在传统锁相五耻引入一条压控移相器反馈控制支路对输入数据流先进行相位调整,再送入鉴相器进行相位比较,从而改善了普通上环定时再生电路的输入抖动容限,使该电路既有很高的等效Q值,又有较大的输入抖动容限,因此能同时兼容ITU-T建议G.958规范的两种SDH再生中继器,文中从理论上分析了VCPS支路对整个定时再生电路输入抖动容限和抖动传递函数的影响 相似文献
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Pinpin Yan Wei Hong Jixin Chen 《Journal of Infrared, Millimeter and Terahertz Waves》2008,29(3):282-290
A millimeter wave phase locked and frequency multiplying source is proposed in this paper. The design includes an X-band phase locked loop (PLL) frequency synthesizer as the base frequency source, and a monolithic millimeter wave frequency tripler, which is developed by using OMMIC 0.18μm pHEMT process. The PLL and the tripler are integrated in a single circuit board to make a low-cost and compact frequency source with the size of 6cm × 5cm. Measurement shows an output power of more than 4.8dBm at the frequency range from 35 to 36.7GHz. A phase noise of about -92dBc/Hz at 100kHz offset is achieved. 相似文献
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以一种适用于现场可编程门阵列(FPGA)芯片的宽频率范围电荷泵锁相环(CPPLL)为例,介绍了一种通过添加简单辅助电路来减小锁相环(PLL)上电锁定时间的方法.该方法在传统电荷泵锁相环的基础上添加了预充电电路,可以大大减少压控振荡器控制电压(VCIRL)拉升的时间.除此之外还添加了频率比较电路,将较宽的频率范围分成若干... 相似文献
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通过介绍DDS+PLL的工作原理,综合利用PLL和DDS的优缺点,提出了扫频源频率合成电路设计方案。主要针对具体电路的设计与实现方法进行详细阐述,给出了相应测试数据,并对相关问题进行了分析。 相似文献
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针对鉴频鉴相器(PFD)的盲区现象对锁相环路的锁定速度的影响,设计了一种PFD结构,可以实现锁相环路的快速锁定。该结构在传统PFD的基础上,利用内部信号的逻辑关系进行逻辑控制,其输出特性呈现非线性;在输入相位差大于π时,抑制了复位脉冲的产生,避免了输入时钟边沿的丢失,有效消除了盲区,加快了锁相环的锁定速度。设计采用SMIC 0.18μm标准CMOS工艺,采用全定制设计方法对该PFD结构进行了设计、仿真分析和验证。结果表明,采用该PFD结构的锁相环,在400 MHz工作频率下锁定时间为2.95μs,锁定速度提高了34.27%。 相似文献
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利用Cadence集成电路设计软件,基于SMIC 0.18 μm 1P6M CMOS工艺,设计了一款2.488 Gbit/s三阶电荷泵锁相环型时钟数据恢复(CDR)电路.该CDR电路采用双环路结构实现,为了增加整个环路的捕获范围及减少锁定时间,在锁相环(PLL)的基础上增加了一个带参考时钟的辅助锁频环,由锁定检测环路实时监控频率误差实现双环路的切换.整个电路由鉴相器、鉴频鉴相器、电荷泵、环路滤波器和压控振荡器组成.后仿真结果表明,系统电源电压为1.8V,在2.488 Gbit/s速率的非归零(NRZ)码输入数据下,恢复数据的抖动峰值为14.6 ps,锁定时间为1.5μs,功耗为60 mW,核心版图面积为566 μm×448μm. 相似文献
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讨论锁相环的原理及应用,设计基于锁相环CD4046的锁相频率合成器和鉴频电路,对电路作了实验验证和分析。该设计电路简单实用。能较好地说明锁相环的应用设计过程及优势,利于对锁相环应用的研究。 相似文献
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CC4046集成电路锁相环采用RC型压控振荡器,外接RC作为充放电元件,电路简单、成本低廉、实用价值大,可广泛应用于广播电视系统,各种通信系统,以及频率合成,自动控制及时钟同步等技术领域。利用数字集成锁相环组成温控变频电路可以克服常见温控系统可靠性低、抗干扰能力差的缺点,为温度的精确测量及需要进行温度检测控制的设备提供了一种可行的电路设计方案。 相似文献
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信号源的合成技术按频率合成的方法可分为三大类:直接式频率合成,锁相式频率合成和直接数字式频率合成.以Peregrine公司的一款高性能单片锁相环频率合成器PE3236为例,介绍了微波信号源发生器研制中的关键实现技术,并给出部分实验测试数据. 相似文献