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DDS的杂散对比与级联方案的研究 总被引:2,自引:0,他引:2
级联是一种通过抑制相位舍位误差来降低DDS输出杂散的设计方案。本文首先对DDS的相位舍位杂散和无相位舍位件下的幅度量化杂散进行了分析和仿真,通过两者在杂散水平和频谱特性上的对比为级联方案的可行性提供理论依据,在此基础上给出两种级联方案,并对方案进行了研究和输出仿真。 相似文献
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DDS频率合成器杂散的分析与仿真 总被引:6,自引:1,他引:5
在理论分析的基础上,利用MATLAB中DSPBulider建立DDS系统,通过实验对DDS的输出进行了时、频域仿真.通过定义输出信噪比,对不同参数设置对系统输出频谱的影响进行了比较,从而为实际系统参数选择提供了指导。 相似文献
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通过介绍直接数字频率合成的基本原理及性能特点,指出了DDFS中存在的几种杂散(相位截断、幅度量化、DAC转换);主要分析了相位截断杂散对频谱的影响;重点提出从确定最佳相位保留字长的角度来优化相位截尾误差,从而达到相位截断杂散的抑制。 相似文献
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直接数字式频率合成技术作为一种全数字系统,在硬件方面具有许多优点。但是受奈奎斯特定理、自身的结构缺陷以及目前数字器件工作速度的限制,DDS输出频率较低、杂散性能不够理想,在应用上受到了一定程度的限制。对DDS进行误差分析对于提高系统性能具有重要意义。介绍直接数字频率合成技术的原理,针对相位截断误差,对DDS合成信号的频谱杂散性进行了详细的理论分析,得到采样点数N与截断部分分母M与信噪比的关系曲线,给出了定量分析结果。并结合应用实践,讨论了不同因素对信噪比的影响,提出提高信噪比的方法和思路。 相似文献
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直接数字频率合成杂散抑制方法的研究 总被引:10,自引:0,他引:10
在理想条件下分析了直接数字频率合成(DDFS)输出信号的主频谱,在此基础上,引入了延时叠加法来减少其杂散分量,本文也讨论了DDFS线路中器件本身的非理想特性引起的量化噪声及减小量化噪声的方法,采用上述这些方法后,DDFS输出信号的频谱中的杂散和噪声得到了较大的改善,如要进一步抑制DDFS的杂散和噪声,则应考虑应用DDFS+PLL方案。 相似文献
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VHDL实现的基于DDS技术的干扰信号 总被引:1,自引:0,他引:1
VHDL作为一种硬件描述语言,用于描述硬件电路的功能、信号连接关系及定时关系,在电子工程领域得到了广泛的应用。DDS(直接数字频率合成)是将先进的数字处理理论与方法引入频率合成的一项新技术。介绍了DDS的基本原理及其调制特性,并利用VHDL语言编程实现了DDS;介绍了基于DDS技术的噪声调频干扰信号的产生,给出了其主要部分的仿真结果,验证了其正确性。 相似文献
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基于高性能FPGA实现的DDS电路是某些对于控制方式、置频速率等方面有特殊要求场合的最佳选择。通过把DDS的核心部件——相位累加器改进为回旋相位累加器,使得存储波形数据的ROM空间降低50%,频率分辨率提升了1倍。另外,在QuartusⅡ,VC与Labwindows/CVI的混合仿真环境下,使得设计完全避免了硬件平台的限制,增加了硬件实现的成功率。 相似文献
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DDS是一种新型频率合成技术 ,应用日益广泛 ,但杂散含量高成为其进一步发展的瓶颈。本文首先简要介绍传统 DDS,然后对计算法 DDS做数字实现和频谱分析 ,最后比较 2种 DDS的杂散性能 ,得出计算法 DDS杂散性能优于传统 DDS杂散性能 相似文献
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本文简要说明了直接数字频率合成器原理,分析了DDS输出频谱杂散的误差来源,介绍了抖动注入法、正弦查找表的幅度压缩方法和DAC平衡法等DDS频谱杂散抑制方法,详细阐述有关原理和具体实现方法。 相似文献
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