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低压低功耗运算放大器结构设计技术 总被引:6,自引:0,他引:6
低电压、低功耗、动态摆幅达到轨到轨(Rail—to—Rail)的运放是实现SOC设计的核心,而相关的输入输出模块是其中的关键技术。本文分析了两种分别工作于弱反型区和强反型区的恒跨导Rail—to—Rail输入级,同时给出了低压和极低压下两种AB类控制输出级的实现方案,并对各方案进行了比较和总结。 相似文献
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基于CSMC 0.6 μm标准CMOS工艺,实现了一种电源自适应Rail-to-Rail CMOS运算放大器,其输入级从原理上变“被动地“适应低电压为“主动地“要求低电压.当外部电源电压在2.1V到3.2 V变化时,内部电源电压稳定在1.68 V,最大偏差为5.4%.这样,内部电源电压自适应地稳定在“相交条件“,实现了输入级的跨导Gm为常数:在整个共模(CM)电压变化范围内,输入级跨导的最大变化为9%.Rail-to-rail输出级用两个折叠网格和AB类反馈控制结构实现,使输出级的最低电源电压降到Vgs 2Vds,并使输出静态电流最小. 相似文献
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基于新型的折叠电流镜负载PMOS差分输入级拓扑、轨至轨(Rail-to-Rail)AB类低压CMOS推挽输出级模型、低压低功耗LV/LP技术和Cadence平台的实验设计与模拟仿真,采用2μmP阱硅栅CMOS标准工艺,得到了一种具有VT=±0.7V、电源电压1.1~1.5V、静态功耗典型值330μW、75dB开环增益和945kHz单位增益带宽的LV/LP运算放大器。该器件可应用于ULSI库单元及其相关技术领域,其实践有助于CMOS低压低功耗集成电路技术的进一步发展。 相似文献
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低功耗CMOS集成运算放大器的研究与设计 总被引:2,自引:0,他引:2
基于0.35μm N阱硅栅CMOS标准工艺,设计了一个工作电压为±2.5 V的CMOS两级全差分运算放大器。通过采用密勒电容和调零电阻串联的补偿电路,有效地改善了电路的频率响应特性,提高了转换速度,使该两级运算放大器在获得较大输入共模范围和输出摆幅的同时,还获得了较高的增益及相位裕度,满足便携式电子产品的低功耗、高性能要求。Cadence SpectreBSIM3V3模型仿真结果表明,在10 GΩ负载电阻和1 pF负载电容并联的条件下,该两级运算放大器的功耗为3 mW,开环直流电压增益为73 dB,单位增益带宽达到90 MHz,相位裕度为47°。 相似文献
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基于UMC的0.6μm BCD 2P2M工艺,探讨了一种高性能Rail-to-Rail恒定跨导CMOS运算放大器.该运算放大器的输入级采用互补差分对,其尾电流由共模输入信号来控制,以此来保证输入级的总跨导在整个共模范围内保持恒定.输出级采用ClassAB类控制电路,并且将其嵌入到求和电路中,以此减少控制电路电流源引起的噪声和失调.为了优化运算放大器低频增益、频率补偿、功耗及谐波失真,求和电路采用了浮动电流源来偏置.该运算放大器采用米勒补偿实现了18MHz的带宽,低频增益约为110dB,Rail-to-Rail引起的跨导变化约为15%,功耗约为10mW. 相似文献
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一种低电压全摆幅CMOS运算放大器 总被引:4,自引:0,他引:4
提出了一种工作于 3 V电压、输入输出均为全摆幅的两级 CMOS运算放大器。为使放大器有较小的静态功耗 ,运算放大器的输入级被偏置在弱反型区 ;输出级采用甲乙类共源输出级 ,以达到输出电压的全摆幅。模拟结果显示 ,在 1 0 kΩ负载下 ,运算放大器的直流开环增益为 81 d B,共模抑制比 91 d B;在 3 p F电容负载下 ,其单位增益带宽为 1 .8MHz,相位裕度 5 9° 相似文献
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文章设计了一种1.8-VRail-to-RailCMOS运算放大器。采用电平移位控制的互补差分输入级,实现了Rail-to-Rail的共模输入范围;由偏置在AB类的电流驱动的共源放大器构成输出级;为了能够处理宽的电平范围和得到足够的放大倍数,使用折叠式共源共栅结构作为前级放大。用CadenceSpectre仿真器,1.8V单电源供电,TSMC0.25-混合信号模型仿真,直流增益为80.18dB,相位裕度为65°,功耗336W。整个电路结构简单紧凑,适合于低电压应用。 相似文献
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设计了一个1.5 V低功耗轨至轨CMOS运算放大器。电路设计中为了使输入共模电压范围达到轨至轨性能,采用了NMOS管和PMOS管并联的互补差动对输入结构,并采用成比例的电流镜技术实现了输入级跨导的恒定。在中间增益级设计中,采用了适合在低压工作的低压宽摆幅共源共栅结构;在输出级设计时,为了提高效率,采用了简单的推挽共源级放大器作为输出级,使得输出电压摆幅基本上达到了轨至轨。当接100 pF电容负载和1 kΩ电阻负载时,运放的静态功耗只有290μW,直流开环增益约为76 dB,相位裕度约为69°,单位增益带宽约为1 MHz。 相似文献
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与工艺无关的Rail-to-Rail CMOS运算放大器 总被引:1,自引:0,他引:1
设计了一种与工艺无关的Rail-to-Rail运算放大器,它采用一种新型的与工艺无关的恒跨导Rail-to-Rail输入级结构,输入级的P管对和N管对的宽长比不需匹配特定的工艺。同时,还采用了前馈AB类控制的rail-to-rail输出级,以保证输出绢有大的动态输出范围和较强的驱动负载的能力。在电源电压为2.7V时,整个运算放大器在0.35μmAlcatel工艺和0.6μm无锡上华工艺下模拟,其输入级跨导偏差分别为7%和14%,直流增益分别为87.9dB和78.4dB,单位增益带宽分别为14MHZ和9MHZ,相位裕度为67度和75度。 相似文献
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