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引言近几年来;;随着计算技术的发展;;对甚高速存貯器的要求大大地提高了。在商用計算机中通常采用周期时間小于500毫微秒字长小于100位的便条存貯器。由于制造大存貯器此制造小存貯器复杂得多;;所以同样速度的較大存貯器尚未在商业上应用。这些問題集中在位讀出系統中产生的瞬态过程上。 相似文献
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航天事业对存储系统的存储速度及保密性的要求在不断提高,针对这些要求提出了双通道编码高速存储系统的设计;设计了一种以RS-422和LVDS为通信手段,双端口RAM为缓存介质,双片选交替双平面混编存储为技术,混合编码存储为特点,K9WBG08U1M芯片为存储核心的高速、大容量的存储系统;双通道编码高速存储系统解决了双路数据存储速率低的问题;最后,对系统采集的数据进行科学分析及图像还原,验证了高速存储系统的可靠性. 相似文献
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为了准确、完整地记录导弹在发射与飞行过程中的各种状态参数,并且对存储数据进行高速回收处理,设计了一种基于千兆以太网的高速智能存储系统。该系统以FPGA为控制中心,将PCM数据码流接收后经过编码解析存入Flash,最后通过千兆以太网、RS422多模式接口将数据快速回传至上位机显示。经试验验证,该智能存储系统具有传输速率高、抗干扰能力强、可靠性高等特点,能够满足弹载数据存储测试的要求,目前已成功应用于某弹射试验弹弹载数据测试中。 相似文献
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对高速数据采集系统进行了研究,基于其采集速率的问题,提出了一种基于FPGA的高速数据采集系统。利用FPGA实现对12bit的A/D转换器ADC12D800的控制,使用其1.6Gsps双沿采样工作模式完成对400MHz以下高频信号的数据采集。通过设计数据存储方式来降低数据传输速率,使数据经USB传至PC机来实现高频信号地实时采集与存储。实验结果表明它可以实时、高效地完成数据采集,可以应用到雷达、通信、电子对抗等领域。 相似文献
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KD10A10位高速数据采集卡 总被引:4,自引:0,他引:4
讨论了一种商品化的高速、10位分辨率的数据采集卡的设计要点,它包括模拟输入、A/D转换、数据缓存、重复采集控制,计算机接口等电位的设计,可广泛应用于雷达、声纳等各类周期或非周期信号的采集与处理领域。该采集卡可直接插在各类计算机的扩展槽中,构成一功能完善的高速、高精度、大存贮量、可重复采集的数据采集系统。 相似文献
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王行刚 《计算机研究与发展》1975,(4)
描述MU5计算机系统最初想法的文章是在1968年发表的。此后六年中,这个设计完成了,硬设备和软设备也都实现了。该系统在1974年夏天开始使用,并继续探入研究整个系统的特点和性能。本文根据MU5设计者之一,F.H.Sumner先后发表的三篇有关MU5存储系统设计的文章以及有关资料,介绍一些MU5存储系统设计中的特点,供参考。系统设计提要 MU5计算机系统是几台处理机和存储器的集合体,它们之间通过交换器联接,如图(1)所示。存储器和处理机可按需要增减。目前这个系统包含一台曼彻斯特大学(Manchester University)的新机器MU5,和一台修改过的ICL公司的1905E计算机。每台处理机有它自己的存储器,公共访问通过交换器。 相似文献
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针对目前靶场光学测量设备大量使用高帧频、高像素值的数字CCD相机,设计了一种基于SCSI接口的高速数字视频存储系统;硬件平台采用普通PC机,软件使用ASPI指令直接在数字视频采集卡和SCSI适配器之间通过64 bit PCI-X总线实现数据传输,避开了操作系统和文件系统的速率瓶颈;在实际应用中可实现带宽为100MB/s,总容量为200GB以上的数据存储,取得了预期效果;实现了低成本平台和高效率存储的统一. 相似文献
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本文设计了基于FPGA和SATA SSD的小尺寸嵌入式存储系统,通过多路高速接口接收数据,采用DDR缓存、DMA仲裁传输和文件管理等技术,利用MicroBlaze软核实现系统运行和读写控制。测试结果表明,该系统体积小巧、功耗较低、使用灵活,可以实现高速数据稳定可靠存储。 相似文献
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《计算机应用与软件》2016,(1)
针对当前MCS51指令集的微处理器指令执行效率低问题,设计一款高速微处理器。其特点是:首先,采用快速乘除器和基4快速除法器,其计算速度是传统乘法器和除法器计算速度的48倍;其次,采用32位指令总线,能一次从ROM读取4个字节,覆盖所有指令长度,减少取指周期数;此外,使用五级流水线,能在单周期完成大多数指令;在Altera EP3C16 FPGA芯片上进行物理验证,根据Dhrystone 2.1性能测试,在相同的时钟频率下其综合性能是传统MCS51微处理器的12倍。实验结果表明,通过上面3种改进方法,微处理器指令执行效率得到极大提高。 相似文献
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介绍了遥测数字视频信号的高速采集与实时存储,主要阐述了系统整体设计、存储器硬件设计、FPGA逻辑时序设计以及系统自检测试;其中硬件设计包括数据解码、Flash硬件设计以及LVDS调度模块,时序设计包括视频信号采集模块时序和Flash读写擦控制时序;本设计由FPGA来控制视频信号的高速采集和图像数据的高速串化与解串,通过LVDS接口传输方式进行Flash存储,再将存储模块中的数据读出,发送至地面综合测试台进行解包分析,完成自检功能。其中输入数据码流为31MB/s,供电电压28V左右,帧率为100帧/秒;本设计具有高码流、存储容量高的特点,大大提高了遥测系统的可靠度,已经在项目中得到应用。 相似文献
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