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非对称数字用户环路(ADSL)是一种宽带接入网技术,对其调制解调器电路中模数转换器的带宽和精度要求较高。∑△调制器具有高精度和低功耗的优点,但是由于采用过采样技术,其带宽较小。为了增加带宽适合宽带应用,本文采用基于块数字滤波器的调制器结构设计了应用于ADSL的两通道二阶宽带∑△调制器系统。该∑△调制器在不提高系统时钟频率的条件下,可使系统的有效采样频率增为原来的两倍,从而使得其带宽增加1倍。采用带通噪声传递函数降低了由于通道系数失配而折叠到信号带宽内的噪声,提高了调制器的信号噪声失真比。利用SIMULINK软件工具对电路非理想特性进行了建模和仿真,仿真结果表明在系统时钟频率为71.4MHz,系数失配为0.5%的条件下,调制器的带宽为1.1MHz,噪声失真比为83.9dB,满足ADSL的应用要求,并且该调制器能够有效地抑制闲杂音,不需要采用随机扰动信号来抑制调制器的闲杂音,简化了后续的电路设计。 相似文献
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在简要介绍高阶1位量化∑-△A/D转换器基本原理的基础上,分析了∑-△调制器的噪声特性;介绍了传统线性模型下的噪声传递函数的设计方法.同时,结合实际高阶模拟∑-△调制器的开关电容实现电路,重点对影响调制器性能的非理想因素进行了详细分析,并采用程序建模仿真的方法指导电路设计.与传统设计方法的结果对比表明,文中的方法可以为电路设计提供更加可靠的依据. 相似文献
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本文将量化器等效为增益可变的加性噪块模型,研究了1bis高阶∑△调制器的稳定性,提出了一种设计1bis稳定高阶(>2)∑△调制器的方法,该方法简单有效。 相似文献
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本文介绍了高阶单比特∑△调制器在小数分频频率综合器中的应用。普通小数分频频率综合器容易产生很大的杂散频率,采用∑△调制器可以有效消除杂散频率降低相位噪声。由于多比特MASH结构的非线性,这里采用单比特高阶∑△调制器(CIFB),最后提出实现电路。 相似文献
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摘要:通过设计一种新的噪声整形滤波器,本文提出了一种新颖的∑-△调制器结构,可用于实现用较低比特位数的数字信号表示较高比特位数的输入信号.该调制器与传统的∑-△调制器相比,其输出数字信号比特位数(或动态范围)降低了许多.理论推导分析和仿真对比的结果表明,在量化噪声整形和噪声频谱上,该调制器的各项性能有了很大的提高,而且证明了这类调制器是稳定的. 相似文献
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为了满足在行为级对∑-△调制器进行完整仿真的需要,提出了在SIMULINK环境下∑-△调制器的噪声模型,包括采样时钟抖动、开关热噪声(kT/C噪声)、运算放大器的有限增益、有限带宽、压摆及饱和电压等非理想因素。在给出具体噪声模型的基础上,构造出二阶∑-△调制器模型。通过仿真,验证了噪声模型的正确性。 相似文献
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在简要介绍高阶1位量化∑-ΔA/D转换器基本原理的基础上,分析了∑-Δ调制器的噪声特性;介绍了传统线性模型下的噪声传递函数的设计方法。同时,结合实际高阶模拟∑-Δ调制器譬开关电容实现电路,重点对影响调制器性能的非理想因素进行了详细分析,并采用程序建模仿真的方法指导电路设计。与传统设计方法的结果对比表明,文中的方法可以为电路设计提供更加可靠的依据。 相似文献
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设计了一种用于测量系统的20位精度带通∑-△调制器。采用低失真离散时间单环4阶1比特量化结构,以实现高精度的指标。对带通调制器中最关键的模块-谐振子进行了研究,设计了一种对电容非线性和失配不敏感并具有精确谐振频率的高Q值谐振子。仿真结果表明,该调制器在100kHz中频处20Hz带宽内实现了20位分辨率。本调制器采用AMI0.35μm标准CMOS工艺实现,整个调制器的总面积仅为2.5mm^2,在3.3V供电电压下,调制器的总功耗仅为4mW。 相似文献
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设计了一种适用于无线窄带射频接收系统的带通∑-△调制器,并将其成功集成于一个无线射频收发芯片之中。该调制器采用0.35μm CMOS工艺实现,采用斩波-稳零,动态元件匹配,以及正交采样等技术,提高系统的信噪比,并解决通道间失配的问题。模拟结果表明,该电路在30kHz带宽内,信噪比为83.4dB,而两个通道消耗的总电流仅为1mA。 相似文献
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为了实现对带外量化噪声进行有效抑制,基于对电荷泵(CP)电流不匹配引起的△-∑量化噪声建模,该文提出一种新型小数分频频率合成器(Frac-N)模型。该模型是在传统小数分频频率合成器的反馈之路上嵌入一个噪声滤除器(NF),该噪声滤除器是由一个不含分频器的宽频带锁相环(PLL)构成。采用该噪声滤除技术不但可以对高阶△-∑调制器(DSM)产生的带外相位噪声进行抑制,还可以减小由于电荷泵(CP)不匹配引起的量化噪声。仿真结果验证了该方法的有效性。 相似文献
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文章对一阶和二阶单级电流模式∑-△调制器作了系统性能及稳定性分析,给出了两者的噪声传递函数。针对系统性能与稳定性这两个相对立的指标,给出了极点的指引。最后介绍了一个一阶调制器的设计实例。 相似文献
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本文提出一种新颖的∑-△调制器结构设计,实现用较低比特位数的数字信号表示较高比特位数的高速信号。与传统的∑-△调制器不同,该调制器采用了新颖的量化噪声整形滤波器使输出信号具有较低比特位数。在调制器的结构设计中,采用了流水线一反馈型的实现结构,使处理过程消除了乘法运算。该结构易于系统实现和提高处理速度。本文用Simulink对调制器进行了仿真研究。研究结果表明本文提出的调制器适合于高速信号的实时处理。 相似文献
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高阶∑-△调制器的非理想特性分析与建模 总被引:1,自引:1,他引:0
文章对2-1-1级联结构的高阶∑-△A/D调制器的非理想特性,包括时钟抖动、MOS开关噪声、比较器迟滞性、放大器的输入噪声、单位增益带宽和有限直流增益等,进行了分析,提出了基于Matlab的高层次建模方法。通过系统仿真确定关键的电路参数和性能指标,在较高层次指导A/D转换器的电路结构级和晶体管级设计。 相似文献
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实现了一种适用于信号检测的低功耗∑-△调制器.调制器采用2阶3位量化器结构,并使用数据加权平均算法降低多位DAC产生的非线性.调制器采用TSMC 0.18 μm混合信号CMOS工艺实现.该调制器工作于1.8V电源电压,在50 kHz信号带宽和12.8 MHz采样频率下,整体功耗为3 mW,整体版图尺寸为1.25 mm×1.15 mm.后仿真结果显示,在电容随机失配5‰的情况下,该调制器可以达到91.4 dB的信噪失真比(SNDR)和93.6 dB的动态范围(DR). 相似文献