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1.
电阻耦合型神经 MOS晶体管是在电容耦合 (浮栅 )型神经 MOS晶体管基础上提出来的 ,它克服了电容耦合型神经 MOS晶体管中由于电容耦合而产生的缺点。文中介绍了电阻耦合型神经 MOS晶体管的基本结构和特点 ,并将它应用于差分四象限模拟乘法器 相似文献
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提出了一种结构简单的采用 Bi CMOS线性区跨导和输入预处理电路的低压 Bi CMOS四象限模拟乘法器 ,详细分析了电路的结构和设计原理。设计采用典型的 1.2 μm Bi CMOS工艺 ,并给出了电路的 SPICE模拟结果。模拟结果表明 ,当电源电压为± 3V时 ,功耗小于 2 .5m W,线性输入电压范围大约± 2 V。当输入电压范围限于± 1.6 V时 ,总谐波失真和非线性误差均小于0 .8% ,- 3d B带宽大于 110 MHz。 相似文献
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钟控神经MOS晶体管的建模及其电路仿真 总被引:1,自引:1,他引:1
神经 MOS晶体管 (简称 Neu MOS)是最近才发明出来的一种高功能度的多输入多阈值的新型 MOS器件。在其十年的发展历程中 ,一些新型结构又被陆续提出 ,以期获得更加优越的性能。文中建立了一种新型Neu MOS即钟控 Neu MOS晶体管的 PSPICE子电路模型 (库 ) ;并利用该模型对由钟控 Neu MOS晶体管构建的电路进行了实时模拟 ,模拟结果与电路特性的实测结果有很好的吻合 ,因此可证明建立的子电路模型 (库 )可用于钟控 Neu MOS晶体管电路的设计和模拟验证。 相似文献
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洪志良 《固体电子学研究与进展》1995,(4)
介绍建立于MOS管平方特性,由28个CMOS管组成的四象限CMOS模拟乘法器。以P阱CMOS工艺制备的电路在电源电压1/3动态范围内,有最大线性误差小于2%的特性,乘法器带宽为62kHz,在±5V电源电压下,功耗为5mW,芯片面积为0.47mm2。 相似文献
5.
本文提出了一种CMOS四象限模拟乘法器。这种乘法器基于MOS晶体管的电流-电压平方关系,采用线性MOS跨导器、悬浮电压发生器和线性MOS电阻完成乘法运算。这种乘法器具有单端输出电压和较好的温度特性。文章比较详细地介绍了电路特点和工作原理,分析了电路的温度性能,并给出了SPICEⅡ的模拟结果。 相似文献
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提出了一种采用有源衰减器和全差分电流传输器(FDCCⅡ)为核心的新型低压CMOS四象限模拟乘法器.PSPICE仿真表明,当电源电压为±1.5 V时,电路功耗小于75μW.该乘法器电路具有较好的线性输入范围,达到±1 V,当输入电压范围限于±0.8V时,非线性误差小于0.6%,-3 dB带宽约为10 MHz. 相似文献
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一种低压高线性CMOS模拟乘法器设计 总被引:1,自引:1,他引:1
提出了一种新颖的CMOS四象限模拟乘法器电路.该乘法器基于交叉耦合平方电路结构,并采用减法电路来实现。它采用0.18μmCMOS工艺,使用HSPICE软件仿真。仿真结果显示,该乘法器电路在1.8V的电源电压下工作时,静态功耗可低至80μW,其线性输入范围达到±0.3V,-3dB带宽可达到1GHz,而且与先前低电压乘法器电路相比,在同样的功耗和电源电压下,具有更好的线性度。 相似文献
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一种结构简单的低压CMOS四象限模拟乘法器 总被引:1,自引:0,他引:1
提出了一种结构简单、采用有源衰减器的低压CMOS四象限模拟乘法器。详细分析了电路的结构和设计原理,给出了电路的PSPICE模拟结果。模拟结果表明,当电源电压为±1.5V时,功耗小于80μW,线性输入电压范围约为±0.5V;当输入电压范围限于±0.3V时,非线性误差小于1.3%;-3dB带宽约为3.2MHz。该乘法器电路可应用于低压模拟信号处理电路中。 相似文献
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基于CSMC0.6μm DPDM CMOS工艺进行设计,利用4个动态闽值NMOS和2个有源电阻实现了一种1.2V低功耗模拟乘法器电路,既节省了输入晶体管数目,又节省了偏置晶体管和偏置电路.1.2V模拟乘法器的输入信号VinA的频率为5MHz,信号峰峰值为1.0V,输入信号VinB的频率为100MHz,信号峰峰值为0.5V时,输出信号Vout的峰峰值为0.35V,一次谐波和三次谐波的差值为40dB.1.2V模拟乘法器输出信号的频带宽度为375MHz,平均电源电流约为30μA,即动态功耗约为36μw,适合于便携式电子产品和带宽要求不太高(400MHz以下)的场合. 相似文献
14.
功率放大器是"电子技术"课程中一个重要内容。本文结合第九届全国大学生电子设计竞赛,介绍了一种由分立的大功率MOS晶体管实现的低频宽带功率放大器系统设计。该系统由阻抗匹配电路、前置放大电路、低通滤波电路、带阻滤波电路和功率放大电路组成。测试结果表明设计满足指标要求。 相似文献
15.
Changku Hwang Akira Hyogo Hong-sun Kim Mohammed Ismail Keitaro Sekine 《Analog Integrated Circuits and Signal Processing》2000,25(3):347-350
A new low voltage high-speed CMOS composite transistor is presented. It lowers supply voltage down to |V
t
|+2 V
ds,sat
and considerably extends input voltage operating range and achieves high speed operation. As an application example, it is used in the design of a high-speed four quadrant analog multiplier. Simulations results using MOSIS 2 m N-well process with a 3 V supply are given. 相似文献
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提出一种通过引入多值求和信号指导设计二值神经元MOS电路的方法.对每个神经元MOS管的逻辑功能均采用传输开关运算予以表示.在此基础上设计了实现常用二变量逻辑函数的神经元MOS电路和全加器等电路.采用所提出的方法综合得到的电路结构十分简单,而且很容易确定各耦合电容之间的取值比例.设计结果同时表明,利用浮栅电压信号易于实现求和的优点,通过引人求和辅助变量可显著简化对电路的综合过程.采用TSMC0.35μm双层多晶硅CMOS工艺参数的HSPICE模拟结果验证了所提出设计方案的正确性. 相似文献