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一种基于LVDS的红外图像长距离传输系统设计 总被引:1,自引:0,他引:1
为实现红外图像数据长距离传输,设计了一种基于LVDS高速串行链路的系统.LVDS传输系统既符合长距离实时红外图像数据传输的要求,又降低了互联总线的数量,减小了系统互联的复杂性和成本.在FPGA内实现LVDS传输需要的图像数据格式转换. 相似文献
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介绍了以FPGA为核心基于LVDS接口的高速通信系统。系统通过FPGA将并行输入的信号组成特定的串行帧格式,并用LVDS接口发送。电缆驱动器及接收均衡器芯片用于加强系统远距离数据传送的能力,以保证200m同轴电缆的数据传输。系统使用串行同步方式传输,接收端首先通过时钟恢复芯片从串行数据帧中提取同步时钟,然后接收串行数据帧并恢复原信号。系统灵活性强、稳定性高,单路传输逮度高达120Mb/s。 相似文献
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LVDS接口LED显示屏数据处理系统设计 总被引:2,自引:2,他引:0
低压差分信号传输(LVDS)技术具有高速、低功耗的特点,已成为宽带高速系统设计的接口标准之一.LVDS技术的应用也为LED显示屏视频接口方案提供了新的选择.LED显示屏可采用LVDS接收器接收来自单板电脑的LVDS视频数据并转换电平.介绍了LVDS接收器SN75LVDS86的结构和原理及与FPGA的连接方式.根据LED显示屏视频显示原理得出对接收到的每点18 bit数据应转换后按颜色、灰度位平面存储于SDRAM中.视频显示是通过FPGA定时从外部SDRAM读取1帧数据再按扫描行、颜色、灰度位平面移位输出到LED显示屏来实现的.作为整个系统核心处理部件的FPGA,采用流水线方式工作实现了LVDS数据接收过程和视频显示过程的并行运行.此外,视频显示过程内部也采用流水线方式工作.分析了该流水线结构相关、数据相关和瓶颈流水段产生原因并给出了可行的解决方案. 相似文献
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随着LVDS技术在高速数字系统中的应用,由于布局、布线等原因使LVDS数据和时钟出现错位情况。本文提出了自校验技术在接收AD9252LVDS信号时的应用,可以使接收到的数据实现自动纠错的功能,从而增加了LVDS数据传输的稳定性。此技术通过Veri10gHDL实现,已通过FPGA验证。 相似文献
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基于FPGA、PCI9054、SDRAM和DDS设计了用于某遥测信号模拟源的专用板卡。PCI9054实现与上位机的数据交互,FPGA实现PCI本地接口转换、数据接收发送控制及DDS芯片的配置。通过WDM驱动程序设计及MFC交互界面设计,最终实现了10~200 Mbit·s-1的LVDS数据接收及10~50 Mbit·s-1任意速率的LVDS数据发送。 相似文献
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LVDS远程传输中继电路的设计应用 总被引:1,自引:0,他引:1
为了解决LVDS信号在远程传输过程中(一般大于100m时)出现的信号衰减、丢数、误码等问题,延长系统间信号传输的距离,提出了一种基于DS92LV18LVDS串行/解串器的中继电路的设计。该中继电路通过接收LVDS信号,并对其进行解串后再次串化输出,实现对信号的加强,从而延长信号传输的距离,并提高信号传输的可靠性。该设计采用FPGA作为中心逻辑控制模块。实际测试结果表明,该电路能很好的解决信号在远程传输过程中出现的上述问题,且该电路体积小巧,连接方便,具有较强的实用性。 相似文献
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《液晶与显示》2017,(10)
为提高多路高速串行图像数据传输在航天应用中的FPGA IO利用率,同时克服接收到的多路并行恢复数据相对相位不确定性问题,采用时钟分路器同时为多路TLK2711和FPGA提供低抖动时钟。对于串行数据发送,采用FPGA内部的数字时钟管理单元(DCM)对发送数据的相位进行调整,并采用TLK2711的内部环回功能进行发送数据和时钟相位的动态自适应调整。对于串行数据接收,采用高速异步数据缓存将多路相对相位不确定的数据调理为参考相同时钟,最终转换为满足Camera Link接口协议的图像数据。实验结果表明,采用时钟分路器可大大降低时钟抖动,该传输系统工作稳定可靠,最大传输速率可达6.8Gbit/s。此方法可大大提高FPGA内部的资源利用率,实现多路并行恢复数据的相对确定相位,满足多通道基于TLK2711的高速串行数据的高稳定传输要求。 相似文献
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提出一种多相机的高速图像传输方法,以克服目前采用LVDS方式进行长距离图像传输技术存在的所需线缆数量大、同时需要进行数据中继、系统的复杂度高的缺陷。系统采用FPGA为主控制器,将接收到的高速相机发出的LVDS格式图像数据转换成TTL信号,并分别输入到指定的存储区中。将相应存储区中的图像数据进行打包处理,送入RocketIO中转换为高速串行数据后,利用光纤进行远距离传输。实验表明,该方法在1.6 Gbps的传输速率下,传输数据量为32 Gbit时,误码数为零,且系统设计简单、性能优良,具有较强的可扩展性。 相似文献
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为解决传统采样数据并行传输时受码间同步及串扰影响的问题,研究了ADC采样数据的高速串行传输协议——JESD204协议,提出了一种具有自主知识产权的、基于FPGA中高速串行收发器GTX实现JESD204协议IP核的方法,实现了对ADC采样数据的高速串行传输并接收。实验表明,采用基于JESD204协议的高速串行传输方式可实现单通道3.2 Gb/s的传输速度,符合机载通信终端小型化的发展趋势。 相似文献
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在通信设施、成像设备、工业仪器仪表等需要大量数据的系统中,要求数据转换级提供越来越宽的分辨率和越来越高的采样率。并行接口的物理布局和串行LVDS方法的比特率限制,给设计人员带来技术障碍。文中基于Xilinx Vertx6 FPGA 的GTX高速串行接口实现了JESD204B协议,有效地解决了传统采集数据并行传输时的各种问题 相似文献
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《现代电子技术》2017,(4):86-90
传统多串口并行通信数据传输系统无法自主获取串口号,需手动选择再打开串口,需要使用者事先了解接口编码,这无形增加了系统的工作时间。为此,设计一种基于FPGA的多串口并行通信数据传输系统,该系统中的串口数据接收模块采集多串口数据,并通过控制寄存器达到控制通信数据波特率的目的。系统利用NiosⅡ处理器使8种信道共同进行传输工作,其将数据传输到并串转换模块。并串转换模块对输出的8位并行数据添加通道标识、并串转换处理,再将处理后的并行数据传递到串口输出选择模块中。依据数据脉冲上升沿设计串口输出选择模块,该模块通过多路分配器将有数据通道的数据串行逐位送出。系统在软件中进行了传输设计、NiosⅡ处理器流程设计以及通信设备类的设计与封装。实验结果表明,所设计系统在FPGA上正确实现了8个串口数据的传输,并且具有较高的数据接收成功率。 相似文献