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该文从概率的角度提出了两类新的滤波器:对称位相型滤波器和对称梯阶滤波器;证明了对任意给定的非负对称滤波器可用这两类滤波器的序列在(-∞,+∞)内一致逼近;这种序列有着统一的结构形式:L(x)=^s∑i=1e^λi│x-μ│^Ni∑k=0ak^(i)│x-μ│^ k。对于L(x),文中给出了选择L(x)一些最优准则的解析表达。从而表明L(x)既具有一般性,又易进行解析处理和数值计算。对于已有文献中相关于对称指数滤波器的两类不同形式,例如Li等和Ma等,该文从理论上进一步刻画了它们的内在一致性。 相似文献
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主要研究了IIR数字滤波器的设计原理及方案,重点介绍了脉冲响应不变法和双线性变换法,并以数字巴特沃斯滤波器为例介绍了其MATALB实现. 相似文献
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《电子技术应用》2017,(12):25-28
设计了采样频率为640 MHz、过采样率为64的高频数字抽取滤波器。该数字抽取滤波器由CIC(Cascaded Integrator Comb)滤波器(降16倍)、CIC补偿滤波器(降2倍)和半带滤波器(降2倍)组成。为了实现高频工作,CIC滤波器采用两级结构,第一级采用多相分解技术,使大部分结构工作在较低时钟频率下,极大地降低了CIC的功耗,第二级采用传统结构。CIC补偿滤波器使信号通带平坦,半带滤波器满足了阻带的衰减要求。为了验证数字滤波器的性能,搭建了四阶前馈—反馈结构ΣΔ调制器,作为数字抽取滤波器的输入,最终在输入信号频率为0.5 MHz时,数字抽取滤波器输出的信噪比为97.40 dB。 相似文献
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本文提出了平移法设计数字滤波器的原理和方法。从理论和实际上证明了存在性和特点,为数字网络的设计又提供了一种实用、用效、快速的工具。 相似文献
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本文介绍了数字滤波器的设计方法,深入探讨了数字滤波器系统结构和特点,并运用相关理论与方法提出了有限冲激响应(FIR)滤波器的设计及仿真。 相似文献
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葛建新 《数字社区&智能家居》2009,(8)
在数字信号处理中,数字滤波占有极其重要的地位。数字滤波是语音和图象处理、模式识别、谱分析等应用中的一个基本处理算法。在许多信号处理应用中用数字滤波器替代模拟滤波器具有许多优势。用DSP芯片实现数字滤波除了具有稳定性好、精确度高、不受环境影响外,还具有灵活性好的特点。该文对数字滤波器的设计与实现方法进行了研究。 相似文献
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本文提出一种用于图像边缘检测的自适应滤波器,利用它既可滤除图像噪声,又可获取精确度高的图像边缘。文中比较详细地分析了这种滤波器,并给出了递归实现算法。理论分析和实验结果表明,自适应指数滤波器的性能优于高斯滤波器。 相似文献
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提出了一种新的用于实现SDH设备时钟的数字锁相环,采用时数转换器来实现数字锁相环中的鉴相器;该时数转换器的时间测量精度达到200 ps,因而极大地改进了鉴相器的鉴相精度;改进后的数字锁相环具有很好的频率稳定度和相位特性,对时钟源有很好的跟踪能力,且能实现时钟源的平滑切换,完全满足了ITU-T G.813规范要求。 相似文献
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一种基于TMS320C5402的数字IIR滤波器设计 总被引:9,自引:0,他引:9
数字IIR滤波器广泛地应用于数字信号处理领域。本文主要介绍了如何在定点DSP芯片上实现IIR数字滤波器,并且通过对IIR滤波器结构的分析,对IIR数字滤波器作了一定简化,使得在定点DSP芯片上容易实现。本文采用TI公司的C54系列DSK并结合MATLAB进行仿真,达到了预期的效果。 相似文献
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用分段累加相关法实现数字相敏检测 总被引:5,自引:1,他引:4
提出了一种数字化相敏检测新算法——分段相关累加法,给出了算法的频率响应公式,分析了不同分段数时该算法对谐波和噪声的抑制作用。最后还给出了实现该方法的微处理器结构。 相似文献
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胡永红 《计算机测量与控制》2006,14(8):1085-1086,1092
为了提高数字锁相环的工作频率、改善环路性能,提出了提高环路的优化设计方法,给出了数字锁相环(DPLL)的工作原理,通过对数字锁相环电路的设计分析,详细论述了利用数字微分将锁相环的鉴相器和环路滤波器完全数字化的电路设计方法,仿真结果表明:环路的工作频率由原来的几百kHz提高到几MHz,目前该数字锁相环已成功地应用于某测控系统中,应用结果证实:该数字锁相环具有工作频率高、捕获时间及精度可调、接口简单、通用性好等特点,可推广应用于远程测量与控制系统中. 相似文献
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基于优化设计Gabor滤波器的边缘提取方法 总被引:12,自引:0,他引:12
基于Gabor滤波器在空间和频率域上都显示良好的局部性能,提出一种用于边缘检测的优化Gabor滤波器的设计方法,并用Canny边缘检测准则对其性能进行了评测.实验结果表明该方法具有良好的边缘检测效果. 相似文献
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长期以来,FIR数字滤波器大多是在频域上实现。因为,在时域上实现FIR数字滤波所遇到的首要问题,是输入信号序列与冲激响应序列的卷积运算速度难以提高。然而,随着超大规模集成电路的飞速发展,硬件集成度与运算速度获得极大的改观,在时域上实现FIR数字滤波已成为可能。IMSA100是高速、高精度32级数字信号处理器,是完成卷积运算的理想器件。本文论证了用IMSA100实现时域FIR数字滤波器的可行性和硬件设计中的一些问题,并给出了应用举例。在设计中选用8031单片机做主控器,大大提高了性能价格比,使这一设计具有很高的实用价值。 相似文献
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本文叙述了一个由TMS32020实现的数字滤波器,对该滤波器的硬件结构与软件编程作了详细讨论。该滤波器由A/D变换、数字滤波和D/A变换三部分组成、TMS32020对A/D转换器的采样采用内部定时器中断的方法,数字滤波使用功能很强的MACD指令。 相似文献