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排序方式: 共有160条查询结果,搜索用时 62 毫秒
101.
102.
改进结构的64位CMOS并行加法器设计与实现 总被引:1,自引:1,他引:0
介绍了一个用于高性能的微处理器和 DSP处理器的快速 6 4位二进制并行加法器 .为了提高速度 ,改进了加法器结构 ,该结构大大减少了加法器各级门的延迟时间 .基于改进的加法器结构 ,有效地使用动态复合门、时钟延迟多米诺逻辑和场效应管尺寸缩小技术 ,可以取得良好的电路性能 .该加法器采用 U MC 2 .5 V 0 .2 5μm 1层多晶 5层金属的 CMOS工艺实现 .完成一次加法运算的时间是 70 0 ps,比传统结构的加法器快 2 0 % ;面积和功耗分别是0 .16 m m2和 2 0 0 m W@5 0 0 MHz,与传统结构加法器相当 . 相似文献
103.
小窑采空区传统处理方式损失可采储量多,影响正常生产时间,造成巨大经济损失,并存在安全隐患。采用充填处理,可以简化生产程序,多回采煤炭资源,创造巨大的经济效益。 相似文献
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为避免操作条件反射学习模型中存在发生小概率操作行为所引发的不良操作后果,设计了一种映射领域可在线自主收缩移动的操作条件反射自动机,映射领域指机器人各状态映射的操作行为集合,其收缩是通过定义学习误差的界限值和操作行为选取的概率阈值两个指标来实现的。对映射领域可自主收缩的操作条件反射学习的收敛性进行了分析,从理论上证明:操作行为熵随映射领域的收缩收敛至极小。针对两轮机器人运动平衡控制的仿真结果表明,映射领域的收缩性使操作条件反射自动机可以在线地在最有意义的映射领域内搜索学习,通过有效的动态的消除无用的映射区域,提高了系统的学习速度和精度。 相似文献
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