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191.
相转移催化合成芳基烷基醚 总被引:7,自引:0,他引:7
报道了以四丁基溴化铵为相转移催化剂,简便地合成了10个芳基烷基醚,反应几乎是定量地快速进行。 相似文献
192.
5%甲·辛颗粒剂中甲拌磷和辛硫磷含量的测定 总被引:1,自引:0,他引:1
本文采用萃取、薄层层析等分离方法,选择合适的萃取剂、展开剂,经分离后,分别刮下甲拌磷和辛硫磷谱带,采用气相色谱法测定甲拌磷含量;采用液相色谱法测定辛硫磷含量。 相似文献
193.
通过将硝胺发射药实际的燃速方程,引入一维定常流、相对变量无量纲的经典内弹道计算程序,计算了RB型硝胺发射药在不同的压力指数及高压力指数区间下,弧厚、药量和挤进压力等起始条件变化对弹道性能的影响.结果表明,高压力指数能增加射击起始条件等参量对弹道性能的敏感性,而且随着高压力指数的增加及其区间的扩大而加剧.但也发现,在弹道性能上,密度为1.620g/cm~3的RB型硝胺发射药的燃速压力指数,对射击起始条件等参量的敏感性与三基药相接近,并未发现明显的弹道不一致性或安全性问题的征候. 相似文献
194.
钢管内径光电检测装置 总被引:3,自引:0,他引:3
介绍了一种检测细长钢管内径的光电检测装置。该装置利用线阵CCD作传感器,采用8031单片机作为主控制。 相似文献
195.
Sha Lu Yong Hu O'Hara M. Bogy D.B. Singh Bhatia C. Yiao-Tee Hsia 《IEEE transactions on magnetics》1996,32(1):103-109
Three sub-25 nm fly height sliders are presented for near contact recording. The designs are geared towards the goal of achieving 10 Gb/in 2 areal density. The optimization procedure presented shows promise for facilitating achievement of this goal. The dynamic simulations show the stability of these designs when disturbed from their steady state conditions 相似文献
196.
197.
Five-terminal silicon-on-insulator (SOI) MOSFETs have been characterized to determine the threshold voltage at the front, back, and sidewall as a function of the body bias. The threshold voltage shift with the body bias at the front and back interfaces can be explained by the standard bulk body effect equation. However, the threshold voltage shift at the sidewall is smaller than predicted by this equation and saturates at large body biases. This anomalous behavior is explained by two-dimensional charge sharing between the sidewall and the front and back interfaces. An analytical model that accounts for this charge sharing by a simple trapezoidal approximation of the depletion regions and correctly predicts the sidewall threshold voltage shift and its saturation is discussed. The model makes it possible to measure the sidewall threshold even when it is larger than the front threshold voltage 相似文献
198.
郝永明古建园林绘画作品另辟蹊径,难能可贵。郝永明的画,不仅给我国美术宝库增加了一份积累,也给古建园林艺术增添了珍贵的资料。 相似文献
199.
McIntyre H. Wendell D. Lin K.J. Kaushik P. Seshadri S. Wang A. Sundararaman V. Ping Wang Song Kim Hsu W.-J. Hee-Choul Park Levinsky G. Jiejun Lu Chirania M. Heald R. Lazar P. Dharmasena S. 《Solid-State Circuits, IEEE Journal of》2005,40(1):52-59
A 4-MB L2 data cache was implemented for a 64-bit 1.6-GHz SPARC(r) RISC microprocessor. Static sense amplifiers were used in the SRAM arrays and for global data repeaters, resulting in robust and flexible timing operation. Elimination of the global clock grid over the SRAM array saves power, enabled by combining the clock information with array select signals. Redundancy was implemented flexibly, with shift circuits outside the main data array for area efficiency. The chip integrates 315 million transistors and uses an 8-metal-layer 90-nm CMOS process. 相似文献
200.