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31.
提出了一种基于改进型径向基函数(Radial basis function,RBF)神经网络的高性能直接数字频率合成器,相比于传统的直接数字频率合成器避免了相位截断误差并降低了资源消耗。为了进一步提高RBF神经网络的训练效率及稳定性,提出一种改进型的RBF神经网络训练算法。该算法在粗调阶段,利用K-means++算法快速确定初始激活函数中心,使激活函数中心分布更加合理;在细调阶段则采用L-BFGS-B算法,对粗调阶段得到的最佳中心进行精细调整,进一步降低输出误差。通用FPGA平台的实验结果表明,基于改进型RBF神经网络的直接数字频率合成器当输出时钟频率为1.53 MHz时,无杂散动态范围为85.26 dB,相位噪声为-90.50 dBc/Hz@100 kHz,且无需占用额外ROM资源。 相似文献
32.
33.
采用65 nm CMOS工艺设计了一款用于高速芯片互联的四电平脉冲幅度调制(PAM4) SerDes发射机。该发射机主要由最高有效位通道和最低有效位通道、时钟产生路径、前馈均衡模块、接口驱动电路等构成。采用一种无锁存的并串转换技术,以降低功耗;采用一种分数型前馈均衡技术,获得了超出奈奎斯特频率点的频率补偿峰值,从而扩展频率补偿范围,使输出信号能更好地适应信道。此外,采用带预充电结构的4∶1并串转换器,减小电荷共享效应对电路的影响。仿真结果表明,在1 V电源电压下,整体电路能实现56 Gbit/s PAM4输出信号,输出眼图清晰,且获得电平失配率为93.1%的高线性度,输出摆幅达到480 mV,功耗为75 mW。 相似文献
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35.
采用标准0.18 μm CMOS工艺,设计了一种相位选择(PS)/相位插值(PI)型半速率时钟数据恢复电路。该电路主要由半速率Bang-Bang鉴相器、改进型PS/PI电路、数字滤波器和数字控制器等模块构成。改进型PS/PI电路通过两个相位选择器和两个相位插值器实现正交时钟的产生,相较于传统结构,减少了两个相位选择器,降低了复杂度和功耗。数字滤波器和数字控制器通过Verilog代码自动综合生成,降低了设计难度。Cadence仿真结果表明,输入2.5 Gb/s伪随机数据时,电路在1.8 μs时锁定,锁定后恢复出的时钟和数据峰峰值抖动分别为17.71 ps和17.89 ps,可以满足短距离I/O接口通信的需求。 相似文献
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39.
随着国内外光伏发电系统的大规模推广和应用,光伏并网逆变器短路故障耐受性能关乎人身安全和系统安全,已经成为设备安全性考核最重要的指标。为了研究逆变器内部短路故障的试验方法以及短路故障对其结构工艺的影响,文中通过对光伏逆变器常规电气性能试验回路、大容量短路试验回路以及相关标准测试要求的研究分析,建立了一种光伏逆变器内部短路故障耐受性能试验方法,并通过搭建试验回路,对该测试方法进行了验证,进一步对试验结果进行了分析。结果表明:设计的试验回路能够实现逆变器内部故障短路试验要求,逆变器内部短路故障会对其结构造成严重破坏,增加保护开关会降低其破坏程度。 相似文献
40.
本文研究了芳香族合成鞣剂-Neosyn系列复鞣剂在猪皮服装革的应用。制定出了一套合理选用Neosyn复鞣剂提高猪皮服装革质量的工艺方案。并比较,阐明了使用Neosyn复鞣剂复鞣后的成革特色。 相似文献