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141.
142.
提出了用VHDL语言实现密勒编码器的设计方案,给出了主要源程序代码和MAX PLUSⅡ环境下的仿真结果,说明了电子设计自动化(EDA)的整个过程。 相似文献
143.
基于卷积码的编译码原理,使用VHDL语言和FPGA芯片设计并实现了(2,1,3)卷积码编译码器.其中译码器设计采用"截尾"的Viterbi译码算法,在支路量度计算、路径量度和译码路径的更新与存储以及判决与输出等环节的实现中采取了若干有效措施,节省了存储空间,提高了设计性能.最后通过仿真验证了设计的正确性与合理性. 相似文献
144.
张有志 《中国新技术新产品》2018,(10)
建筑项目防水工程技术有很多的种类。防水工程施工中应依据设计要求和施工现场环境情况,研究采取科学的防水工程技术,并确保技术得到合理地应用,使得防水工程取得预期的效果。 相似文献
145.
针对低比特率的多媒体视频序列,提出了一种综合利用帧差累积和背景减法来进行运动对象分割的方法。由一种改进的帧差累积方法得到初步的运动对象区域,通过背景减法得到运动对象区域,把由两种方法得到的运动对象区域相结合取得完整准确的结果,二值化后再经过形态学处理和二次扫描填充即可得到运动对象掩模,用原图像的灰度值填充该区域。实验表明,该方法快速,准确,并有一定的应用价值。 相似文献
146.
一种基于HFC的DTV和IP业务动态带宽分配机制 总被引:1,自引:0,他引:1
为了实时充分地利用数字电视业务下行传输中的剩余带宽来尽力而为地传输IP业务,探讨了有线电视网络下行传输中DTV和IP业务动态带宽分配的问题,提出了一种基于业务级别和视频质量评估系统的带宽分配算法,同时给出了相关的结构图和公式. 相似文献
147.
本文采用双延迟线和防错锁控制结构,结合对电荷泵等关键模块版图对称性的匹配控制,设计了一种针对(Time-to-Digital Converter,TDC)应用的宽动态锁定范围、低静态相位误差延迟锁相环(Delay-Locked Loop,DLL)电路.基于TSMC 0.35μm CMOS工艺,完成了电路的仿真和流片验证.测试结果表明,DLL频率锁定范围为40MHz-200MHz;静态相位误差161ps@125MHz;在无噪声输入的理想时钟驱动下,200MHz频率点下的峰-峰值抖动最大为85.3ps,均方根抖动最大为9.44ps,可满足亚纳秒级时间分辨的TDC应用需求. 相似文献