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991.
992.
The number of circuit design iterations due to electrostatic discharge (ESD) failures increases with the complexity of VLSI technologies and their shrinking. In this paper, we show how TCAD and ESD SPICE modeling can be used to solve ESD protection issues in an analog CMOS technology.  相似文献   
993.
Translated from Gidrotekhnicheskoe Stroitel'stvo, No. 10, pp. 1–6, October, 1992.  相似文献   
994.
A comprehensive analysis of a 1-persistent carrier-sense multi-access (CSMA) system using a radio channel with imperfect carrier sensing is presented and discussed. It is shown that a careful optimization of the channel state detector parameters must be performed in order to get good system performance. If the threshold of the detector is too high, the system will tend to behave like an unslotted ALOHA; if the threshold is too low, the system throughput will be zero. It is also shown that for the larger average packet rate G the system throughput is decreased. This is because for the same probability of correct channel sensing, the probability of incorrect transmissions from the waiting mode is increased  相似文献   
995.
Mining Institute, Moscow. Translated from Fiziko-Tekhnicheskie Problemy Razrabotki Poleznykh Iskopaemykh, No. 2, pp. 26–29, March–April, 1991.  相似文献   
996.
997.
998.
On the capacity of a cellular CDMA system   总被引:37,自引:0,他引:37  
It is shown that, particularly for terrestrial cellular telephony, the interference-suppression feature of CDMA (code division multiple access) can result in a many-fold increase in capacity over analog and even over competing digital techniques. A single-cell system, such as a hubbed satellite network, is addressed, and the basic expression for capacity is developed. The corresponding expressions for a multiple-cell system are derived. and the distribution on the number of users supportable per cell is determined. It is concluded that properly augmented and power-controlled multiple-cell CDMA promises a quantum increase in current cellular capacity  相似文献   
999.
Translated from Khimicheskoe i Neftyanoe Mashinostroenie, No. 10, pp. 30–34, October, 1991.  相似文献   
1000.
This paper deals with the parallel execution of algorithms with global and/or irregular data dependencies on a regularly and locally connected processor array. The associated communication problems are solved by the use of a two-dimensional sorting algorithm. The proposed architecture, which is based on a two-dimensional sorting network, offers a high degree of flexibility and allows an efficient mapping of many irregularly structured algorithms. In this architecture a one-dimensional processor array performs all required control and arithmetic operations, whereas the sorter solves complex data transfer problems. The storage capability of the sorting network is also used as memory for data elements. The algorithms for sparse matrix computations, fast Fourier transformation and for the convex hull problem, which are mapped onto this architecture, as well as the simulation of a shared-memory computer show that the utilization of the most complex components, the processors, is O(1).  相似文献   
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