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101.
针对雷达测量系统中的信号处理,探讨了采用现场可编程门阵列(FPGA)的全数字化处理方案.重点研究数据采集、实时压缩编码和数据传输的方法及过程.该文详细论述了基于FPGA的单板信号处理机的模块化设计及实现,并通过仿真和测试验证了设计的正确性.结果表明,该信号处理机具有体积小、重量轻、功耗低、可靠性高等优点.  相似文献   
102.
陈铮  陈禾 《微处理机》1997,(4):42-45
对电子汽车衡计算机管理系统的结构和特点进行了详细的介绍,阐述了本系统的设计方案和系统软、硬件的实现。  相似文献   
103.
针对SoC设计中的IP核复用问题提出了一种基于平台的解决办法。传统方法是将特定功能模块的非标准接口标准化为AHB主/从设备接口,但是这种方法设计效率较低,不便将模块有效地嵌入SoC平台。新的方法是基于ARMSoC通用平台设计寄存器总线标准接口,这种设计使整个系统的结构清晰,设计好的寄存器总线接口可增强系统的通用性,增强了系统中功能模块的可移植性。  相似文献   
104.
利用高速响应可控消弧线圈测量配网电容电流   总被引:4,自引:2,他引:4  
陈禾  陈维贤 《高电压技术》2003,29(4):9-10,28
在用晶闸管高速控制的消弧线圈电路中 ,可用“远离谐振法”测量配网电容电流 ,为此需要平滑地调节控制角 ,以使中性点位移电压达到不对称电压的 4~ 5倍。为了得到精确的计算结果 ,还需引入考虑谐波电流影响的修正系数 ,推导出了后者的计算公式和列出了相应的曲线。  相似文献   
105.
深圳供电局110 kV联城变电站过电压的分析   总被引:2,自引:0,他引:2  
通过电磁暂态计算,对深圳供电局110kV联城变电站可能遭受的雷电及操作过程进行研究,分析了杆塔反击时雷击点,运行方式,保护方式对联城变电站雷电侵入波的影响,最后对联城变电站的防雷措施提出具体改进意见。  相似文献   
106.
离散余弦变换已成为图像压缩中一标准技术,本文给出了基于DA的二维离散余弦逆变换(2-DIDCT)的ASIC设计。本设计通过采用快速1-DIDCT算法及基于DA算法的乘法累加器来减少面积、加快速度。设计采用自顶向下设计方法,用VHDL进行描述,整个系统在SYNOPSYS工具上进行设计及仿真,最终综合到门级电路。  相似文献   
107.
介绍了高速响应可控电抗器的工作原理,推导了选择主要参数的计算公式,叙述了显著降低铁芯损耗的方法,最后指出了这种新型装置广阔的使用领域和发展前景.  相似文献   
108.
配电网中性点位移现象   总被引:5,自引:2,他引:3  
陈禾  陈维贤 《高电压技术》2001,27(6):26-27,30
讨论了配网在正常运行时位移电压 U0 的相量位置、增大 U0 的方法及 位移电压和单相接地电流之间的关系 ,分析了消弧线圈补偿电网中单相断线引起的谐振现象 ,指出 ,实际谐振过电压是不高的。  相似文献   
109.
ASIC Design of Floating-Point FFT Processor   总被引:2,自引:0,他引:2  
An application specific integrated circuit (ASIC) design of a 1024 points floating-point fast Fourier transform(FFT) processor is presented. It can satisfy the requirement of high accuracy FFT result in related fields. Several novel design techniques for floating-point adder and multiplier are introduced in detail to enhance the speed of the system. At the same time, the power consumption is decreased. The hardware area is effectively reduced as an improved butterfly processor is developed. There is a substantial increase in the performance of the design since a pipelined architecture is adopted, and very large scale integrated (VLSI) is easy to realize due to the regularity. A result of validation using field programmable gate array (FPGA) is shown at the end. When the system clock is set to 50 MHz, 204.8 μs is needed to complete the operation of FFT computation.  相似文献   
110.
介绍了一种电抗器的五种线接线方式,它可使未换位线路差别很大的相间电容恢复平衡,满足精确的静电补偿需要,有利于潜供电弧的顺利熄灭。  相似文献   
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