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This work aims to investigate the design and implementation of digital filters for separating clusters in a clustered-orthogonal frequency-division multiplexing scheme for power line communication systems. In this regard, we formulate the mathematical problem and present a criterion which is capable of searching for digital filters that maximizes data rate. In the following, several finite impulse response and infinite impulse response digital filters are analyzed in order to validate the proposed criterion and to verify the best one which fulfills the given constraints. Furthermore, regarding only the best digital filters obtained, a finite precision and complexity analyses are carried out by using a field-programmable gate array device. Based on numerical results, we show that finite impulse response equiripple minimum phase and infinite impulse response Chebyshev type II digital filters yield the best data rates among the chosen digital filters. Moreover, we point out that equiripple minimum phase digital filters consume more hardware resources than Chebyshev type II digital filters, although the first one deal better with the field-programmable gate array constraints when more bits are used to implement the digital filter. Due to that, finite impulse response digital filters are more indicated to be implemented in a field-programmable gate array device. 相似文献
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A small‐area and low‐power data driver IC using two‐stage DAC with a capacitor array for active matrix flat‐panel displays 下载免费PDF全文
Hyeon‐Cheon Seol Seong‐Kwan Hong Oh‐Kyong Kwon 《Journal of the Society for Information Display》2017,25(1):4-11
A small‐area and low‐power data driver integrated circuit (IC) using a two‐stage digital‐to‐analog converter (DAC) with a capacitor array is proposed for active matrix flat‐panel displays. The proposed data driver IC employs a capacitor array in the two‐stage DAC so as to reduce the DAC area and eliminate the need for a resistor string, which has high‐power consumption. To verify the proposed two‐stage DAC, a 20‐channel data driver IC with the proposed 10‐bit two‐stage DAC was fabricated using a 0.18‐μm complementary metal–oxide–semiconductor process with 1.8 and 6 V complementary metal–oxide–semiconductor devices. The proposed 10‐bit two‐stage DAC occupies only 43.8% of the area of a conventional 10‐bit two‐stage DAC. The measurement results show that the differential nonlinearity and integral nonlinearity are +0.58/?0.52 least significant bit and +0.62/?0.59 least significant bit, respectively. The measured interchannel deviation of the voltage outputs is 8.8 mV, and the measured power consumption of the 20‐channel data driver IC is reduced to 7.1 mW, which is less than half of the power consumed by the conventional one. 相似文献
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针对微加速度计接口电路的sigma delta(ΣΔ)数字反馈系统,本文提出一种基于脉宽调制(PWM)的力反馈回路:利用模拟低通滤波器将PWM波解调成模拟输出信号,具有滤波和数模转换功能。首先建立了微加速度计ΣΔ闭环反馈系统的Simulink模型并进行了系统级仿真。之后采用Filter Solutions滤波器设计软件确定三阶低通巴特沃斯滤波器,并采用Pspice仿真软件进行电路级仿真。最后将制作的PCB版电路进行测试:PWM波通过力反馈回路能还原成高保真的模拟信号,输出信号和输入信号的频率相对误差小于0.36%,等效DAC分辨率为8位。试验表明,此方案结构简单、成本低,能以较低电路复杂度实现高精度的模拟信号输出。 相似文献
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该文经过研究和大量的试验利用三极管的非工作区实现了特模拟量直接输入计算机的信息传输方法。该方法将传感器所采集的信息无需进行模数转换,即可直接将模拟量输入到计算机中。该研究的实现不仅降低了信息传输的成本,而且还实现了远距离传输产提高了信息传输速度。它在工控等领域具有广泛的用途。 相似文献
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一个新的MOS模拟单元电路版图的STACK生成方法 总被引:1,自引:0,他引:1
提出了一种新的MOS模拟单元电路的STACK版图自动生成方法。该方法将电路网表映射为扩散图,基于扩散图进行电路划分、模板匹配和对称查找。提出的对称查找算法适用于非全对称电路的最大匹配对称结构查找。文中改进了Atallah欧拉路径生成算法,通过增加哑元条保证欧拉路 径的生成。对生成的STACK,采用分布式寄生电容模型计算各个节点的寄生电容,并计算STACK的面积和形状,以确保其能够满足设计要求。 相似文献
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模拟电路布线通常采用无网格的布线模式,这就存在如何在整个布线平面中确定连线间的contact和via的位置的问题,文中提出了一种在任意曼哈顿多边形中求最大内接矩形的算法,该算法通过准确,快速地搜索出放置contact和via的空间,以提高整个布线的效果并降低布线过程在时间上的消耗。 相似文献