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131.
在分步设计及大量计算的基础上,提出了一套考虑因素相对全面、指导 性强、易于操作的梯级水库电力实用优化调度图。该调度图继承了传统时历法调度图直观、 简明的优点,又具有其特有的优化功能。该方法以汛末蓄满水库为标准,确定典型来水过程 的预调度线和初始目标;以获得梯级电站最大长期调峰收益为目标,以变动目标水位控制为 核心,开发出调度图长系列操作通用程序模块,并以此模块作为寻优计算的手段。提出了水 库长期运行与短期实时调度有机结合,以及模拟计算、水位偏差最优反馈、来水预报、目标 水位寻优等多种实用处理技术。 相似文献
132.
With the advancement of high‐frequency switching devices, electromagnetic interferences (EMI) have become problems in power electronic converter designs. It is necessary for an electromagnetic compatibility (EMC) design to prospect and consider its possible EMI levels. This paper describes how to compute effects from a power converter to an object point to reduce conduction EMI noises effectively by an appropriate design. Modeling techniques for converter elements are discussed for a model in the conduction emission frequency band by the parameter tuning method and for line constants by an analytical derivation. Then a derived model is simulated for harmonic distributions of loop currents and their magnetic fields. © 2002 Scripta Technica, Electr Eng Jpn, 139(1): 44–50, 2002: DOI 10.1002/eej.1145 相似文献
133.
国产核电厂蒸汽发生器下封头群孔接管区具有应力分布复杂、焊接施工条件差的特点。为考核其承受循环载荷的能力,设计制造了与实物相似的模拟试验装置,根据核电厂运行寿命期内的载荷特点,确定了模拟试验装置的试验载荷与试验循环数。循环加载试验的结果表明,蒸汽发生器下封头群孔接管区承受循环载荷的能力在寿命期内是符合要求的。 相似文献
134.
群时延精确设计的全差分四阶Bessel滤波器 总被引:1,自引:0,他引:1
采用MOS管有源电阻,提出了一种全差分R-MOSFET-C四阶Bessel有源低通滤波器,.通过调节工作于亚阈值区的CMOS管的沟道导纳补偿电阻值的大小,能抵消集成电路制造工艺中电阻值的一致偏差,实现Bessel有源滤波器群时延的精确设计.根据无源滤波器的状态方程完成有源滤波器的综合,应用3.3V,0.5μm CMOS工艺完成了群时延大小为0.75μs的四阶Bessel低通滤波器的管极计算机仿真,仿真结果表明所提电路正确有效,适于全集成. 相似文献
135.
通过数值计算和模拟研究,本文叙述了新型可控电抗器的广泛的无功调节功能,揭示了它所具有的大幅度限压的能力,并在理想数学模型的基础上分析了电抗器的限压机理。 相似文献
136.
138.
论述了单片机控制激光电源的原理,提出了产生PWM控制的基本思想及整个控制系统的硬件组成和软件设计方法。 相似文献
139.
140.
Ozgur Sinanoglu Ismet Bayraktaroglu Alex Orailoglu 《Journal of Electronic Testing》2003,19(4):457-467
Parallel test application helps reduce the otherwise considerable test times in SOCs; yet its applicability is limited by average and peak power considerations. The typical test vector loading techniques result in frequent transitions in the scan chain, which in turn reflect into significant levels of circuit switching unnecessarily. Judicious utilization of logic in the scan chain can help reduce transitions while loading the test vector needed. The transitions embedded in both test stimuli and the responses are handled through scan chain modifications consisting of logic gate insertion between scan cells as well as inversion of capture paths. No performance degradation ensues as these modifications have no impact on functional execution. To reduce average and peak power, we herein propose computationally efficient schemes that identify the location and the type of logic to be inserted. The experimental results confirm the significant reductions in test power possible under the proposed scheme. 相似文献