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针对现有的基于载频/时隙关断的基站节能算法没有考虑异构网络之间的协同或者只考虑单一的业务与实际网络情况不相适应的问题,在异构网络环境下提出了动态关断资源栅格(RG,resource grid)的基站节能新算法——DRGSM(dynamic resource grid shut mode)算法。该算法根据网络的即时负载,当有业务接入时,动态打开RG以满足业务的QoS要求;当RG闲置时,即将其关断以实现节能。仿真结果表明,所提算法较现有的基于载频/时隙关断的基站节能算法,明显地降低了能耗,提高了节能百分比。 相似文献
102.
为了能有效提高网络性能,提高资源利用率,使得信息交流更加直接简单。提出了一种LTE-A基于资源利用率的接纳控制跨层设计。该方法将资源利用率和业务QoS满意度联合考虑,同时提出跨层的设计方法,该方法与现存的方法相比,不仅提高了资源利用率也能更好地满足业务的QoS需求。仿真结果表明,该设计能有效提高网络性能,满足各个业务的服务质量。 相似文献
103.
针对部分并行结构的准循环低密度校验(QC-LDPC)码译码器,提出了一种将译码准码字存储在信道信息和外信息存储块中的高效存储方法,该方法不需要额外的存储块来存储译码准码字,能够减少译码器实验所需的存储资源数量,并且有效降低了译码电路的布线复杂度.在Xilinx XC2V6000-5ff1152 FPGA上的实验结果表明,提出的QC-LDPC码译码器设计方法能够在降低系统的BRAM资源需求量的同时有效地提高系统的运行频率和译码吞吐量. 相似文献
104.
105.
This paper introduces a 9-bit time-based capacitance-to-digital converter (T-CDC). This T-CDC adopts a new design methodology for parasitic cancellation with a simple calibration technique. In T-CDCs, the input sensor capacitance is first converted into a delay pulse using a capacitance-to-time converter (CTC) circuit; then this delay signal is converted into a digital code through a time-to-digital converter (TDC) circuit. A prototype of the proposed T-CDC is implemented in UMC 0.13 μm CMOS technology. This T-CDC consumes 8.42 μW and achieves a maximum SNR of 45.14 dB with a conversion time of 1 μs that corresponds to a figure of merit (FoM) of 16.4 fJ/Conv. 相似文献
106.
In this work we propose an optimal back plane biasing (OBB) scheme to be used in a UTBB FD SOI technology that minimizes the energy per operation consumption of sub threshold digital CMOS circuits. By using this OBB scheme, simulations show that more than 30% energy savings can be obtained with low threshold voltage (LVT) devices in comparison with classic symmetric back plane biasing (SBB) schemes. Additionally, this OBB scheme allows to adjust the performance of the circuit with very small energy penalties. A very simple and intuitive model, for sub threshold digital CMOS circuits, was developed to justify the benefits obtained by OBB. The results predicted by the model are confirmed with extensive simulation results. We show that the OBB approach can be applied easily to a given circuit just based on the information provided by a logic simulation of the circuit (or even an analysis of its structure) and simple electrical simulations of the pMOS and nMOS transistors. Finally, we show that the variability in the energy consumption is improved by using OBB and suggests that new sizing methodologies must be studied to fully benefit from the wide back plane voltage range available in UTBB FD SOI technology for the design of robust energy efficient digital circuits. 相似文献
107.
108.
109.
针对频谱有效的多进制低密度奇偶校验(Low-Density Parity-Check,LDPC)码编码调制系统,本文提出了一种在带宽有效传输下的两级不等保护方案,两级不等错误保护分别来自码字特性和高阶调制,充分利用了码字变量节点的度和高阶调制中比特的不等可靠性。编码调制系统采用多进制LDPC码与高阶调制匹配结合,无需信息转换,针对不同误符号率和误比特率的需求,可在符号级和比特级提供不同可靠性达到不等错误保护的目的。仿真结果表明,在AWGN信道下,采用16QAM调制方式的性能优于16PSK调制方式,利用变量节点的度和高阶调制提供的信息,码字的误符号率和误比特率具有明显的不等错误保护区分度,对于重要的比特给予了较强的保护。 相似文献
110.