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991.
使用标准0.18μm CMOS工艺设计并实现了1:2分接器.核心电路单元采用一种新的高速、低电压锁存器结构实现.与传统的源极耦合场效应管逻辑结构的锁存器相比,其电源电压更低且速度更快.此外,为了拓展带宽,在缓冲放大电路中采用了负反馈.测试结果表明芯片可以工作于20Gb/s数据速率下.电源电压为1.8V时,包括缓冲电路在内整个芯片的工作电流为72mA. 相似文献
992.
用积累型MOS变容管实现的2.4GHz 0.25μm CMOS全集成压控振荡器 总被引:1,自引:0,他引:1
基于TSMC 0.25μm CMOS工艺,将一个普通MOS管改进为工作在积累区的MOS变容管,实现了一工作于2.4GHz的全集成压控振荡器(VCO).测试结果表明,采用积累型MOS变容管的VCO具有较大的调谐范围.在2.5V工作电压下,控制电压从0~2.2V,VCO的频率调节范围为2.210~2.484GHz,在2.4GHz时相位噪声为-105dBc/Hz@600kHz,输出功率为-7.55dBm,电流损耗为7mA.芯片面积约为0.35mm2. 相似文献
993.
宁永成 《电子产品可靠性与环境试验》2010,28(3):27-29
目前,国内生产厂和用户针对CMOS集成电路静态电流的测试,仍基于现有的标准和产品规范。但是,采用这些测试方法来测试合格的器件,在使用过程中却发现了某些电路静态电流超差的现象。通过比较目前国内外的标准和规范所规定的方法,分析其存在的问题,并说明了静态电流测试的重要性。通过实验进行了验证说明,并提出了解决问题的建议。 相似文献
994.
W/TiN Gate Thin-Film Fully-Depleted SOI CMOS Devices 总被引:1,自引:1,他引:0
TiN gate thin-film fully-depleted SOI CMOS devices are fabricated and discussed.Key process technologies are demonstrated.Compared with the dual polysilicon gate devices,the channel doping concentration of nMOS and pMOS can be reduced without changing threshold voltage (VT),which enhances the mobility.Symmetrical VT is achieved by nearly the same VT implant dose because of the near mid-gap workfunction of TiN gate.The SCE effect is improved when the thin-film thickness is reduced. 相似文献
995.
996.
On the realization of electronically current-tunable CMOS OTA 总被引:1,自引:0,他引:1
A CMOS operational transconductance amplifier (OTA) called as an EOTA, where its transconductance gain can be electronically and linearly tuned is proposed in this paper. The realization method is achieved by squaring the transconductance gain of the balanced CMOS OTA. The EOTA transconductance gain can be linearly tuned by an external bias current for three decades. The linear input-voltage range of about 1 Vp with less than 1% nonlinearity is obtained. The usefulness of the proposed EOTA is demonstrated through application example with a current multiplier. The performance of the proposed circuit is discussed and confirmed through PSPICE-simulation results. 相似文献
997.
The accuracy of A/D and D/A converters depend largely upon their inner comparators. To guarantee 12-bit high resolution for an A/D converter, a precise CMOS comparator consisting of a three-stage differential preamplifier together with a positive feedback latch is proposed. Circuit structure, gain, the principle of input offset voltage storage and latching time constant for the comparator will be analyzed and optimized in this article. With 0.5 μm HYNIX mixed signal technology, the simulation result shows that the circuit has a precision of 400 μV at 20 MHz. The test result shows that the circuit has a precision of 600 μV at 16 MHz, and dissipates only 78 μW of power dissipation at 5 V. The size of the chip is 210 × 180 μm2. The comparator has been successfully used in a 10 MSPS 12-bit A/D converter. The circuit can be also used in a less than 13-bit A/D converter. 相似文献
999.
本文介绍了一种采用纯软件,利用主板EE ROM剩余空间存放程序而实现的微机CMOS数据保护方法。 相似文献
1000.
系统级CMOS电路的低功耗设计 总被引:4,自引:0,他引:4
随着集成电路规模的增大和工作频率的提高,功耗已经成为面积和性能之外的主要设计目标。低功耗设计可以在不同的设计层次进行考虑,早期的设计确定了系统的构架,对功耗的影响最大,因此本文重点探讨了RTL级和系统级的低功耗设计,具体的途径有:实行有效的功耗管理;采用并行处理和流水线结构;采用分布式的数据处理结构以及用专用电路代替可编程处理器。 相似文献