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R. Galand K. HaxaireL. Arnaud E. PetitprezL. Clement P. WaltzY. Wouters 《Microelectronic Engineering》2011,88(5):661-665
In this article, we focus on the possible influence of interconnect Cu microstructure on electromigration phenomenon. First three annealing conditions were applied on interconnects. Microstructure and texture of copper were characterized by Electron BackScattered Diffraction (EBSD). Then electromigration tests have been carried out on 70 and 150 nm line widths of 45 nm node technology. In both cases no significant difference was observed in term of reliability performance versus annealing conditions. On the contrary large difference is observed on Electron BackScattered Diffraction results. Then, a statistical approach was used to investigate local microstructure and texture of copper for 150 nm line width. The results underline that morphological parameters of copper can vary versus annealing conditions but lead to similar reliability performances. We can thus conclude that these parameters are not in relationship with electromigration phenomena in these interconnects. On the other hand, high amount of misorientation has been highlighted as responsible of early failures. 相似文献
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文章以世界IC市场发展前景为“参照物”,研究、讨论PCB未来市场发展的趋势,以及重点阐述了未来PCB新的巨大市场——数字家电产品的形成问题。 相似文献
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概述了Ag纳米油墨,Cu纳米油墨和合金纳米油墨等印制电子用油墨的开发现状和课题以及利用ITO纳米油墨的透明导电膜形成。 相似文献
76.
随着客户需求的不断变化和对PCB产品外观越来越高的要求,我公司客户对产品外观的要求更为严格,使得我们迫切需要对于过程中影响PCB板件外观的主要因素进行控制。本文主要从电镀铜粒着手,简述铜粒产生的影响因素,并提出可行性建议,给整个铜粒状况改善提供思路和方向。 相似文献
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氯化铵溶液中还原浸出海洋锰结核 总被引:4,自引:1,他引:4
采用亚硫酸钠作还原剂对氯化铵溶液中海洋锰结核的浸出行为进行研究,探讨Na2SO3加入量、NH4Cl浓度及初始pH值、浸出温度和时间等对锰结核中铜、镍、钴、锰、铁浸出率的影响。结果表明5.0mol/LNH4Cl溶液中,初始pH值约5.0及80℃、180min,锰结核与Na2SO3等量加入时,铜、镍、钴、锰的浸出率分别为88.56%、96.14%、78.57%、35.2%,铁几乎未被浸出。而在同样的条件下,控制浸出过程的pH值4.0左右,120min后铜、镍、钴、锰、铁的浸出率分别为90.21%、98.80%、91.43%、98.11%、20.13%。 相似文献
79.
80.
Valery M. Dubin 《Microelectronic Engineering》2003,70(2-4):461-469
Major scaling issues, which need to be addressed to continue scaling according to Moore’s law, include increase of transistor leakage due to use of thin gate oxide (about 1 nm limit for SiO2), power (reaching 100 W/cm2) and RC delay (dielectric constant limit is 1 for air and Cu resistivity increases with scaling down the feature sizes). Integration of new materials and technologies will allow us to continue scaling and improve device performance. Examples of new materials include high-k dielectrics and strained silicon in the frond end of wafer processing, low-k carbon-doped oxide and electroplated copper in the back end of wafer processing as well as electroplated bumps, high thermal conductivity interface, heat sink and heat spreader materials in packaging. Electrochemical technologies will play an increasingly important role in silicon technology due to low cost, use of self-assembly processing and self-aligned growth ability. New electrochemical technologies in silicon processing include copper electroplating (replaced Al interconnect to reduce RC delay and increase reliability), bump electroplating (replaced wire bonding to allow increased I/O and improve reliability), and porous silicon for silicon on isolator fabrication (to reduce transistor leakage). Copper electroplating allows a low R, an excellent gap fill capability and superior materials properties with (111) textured Cu films and large grain size, and a stable and controlled process. 相似文献