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本文设计了一款用于零延迟时钟缓冲器的PLL,采用一种结构简单并且实现低失配的电荷泵,详细阐述了对噪声有很强抑制作用的一种差分结构的压控振荡器,采用CSMC 0.5μm N阱CMOS工艺,在3.3V电源电压下,该PLL的工作频率范围为10MHz-140MHz,周对周抖动为45ps@50MHz,功耗为4.8mW,芯片面积为1.2μm×1.7μm. 相似文献
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伊大成 《电子制作.电脑维护与应用》2009,(8):29-34
为校准计数器、无线电接收器和信号发生器的频率,需要非常精确的10MHz和1MHz的信号源,《基于GPS的基准频率源》介绍的是与GPS相联系的基准频率源,可以获得星上铯射线"原子钟"的高精度信号。 相似文献
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程俊 《数字社区&智能家居》2011,(5):1164-1165
Multisim10是原理电路设计、电路功能测试的仿真软件.该文利用Multisim10对高频电路中的功率放大器和正弦波振荡器进行了分析,其结果符合理论推导.将Multisim10引入到高频实验教学中,不但能提高学生的学习兴趣,帮助学生更好理解原理电路以及相关特性的测试方法,而且还能提高学生的电路设计能力. 相似文献
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实现了一种可重构振荡器与双频率滤波器的协同设计模块。振荡器通过开关二极管的通断来实现频率的可重构,工作频率分别为1.1 GHz和2.0 GHz。与双频滤波器协同设计后,振荡器在两个频率上频偏1 MHz的相位噪声分别从-109.1 dBc/Hz和-112.9 dBc/Hz改善为-125.6 dBc/Hz和-127.9 dBc/Hz,二次谐波抑制分别由协同设计之前的-25 dB和-10 dB改善为-44 dB和-55 dB。 相似文献
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针对传统锁相环输出频率范围有限、功耗大的缺陷,通过对压控振荡器震荡机理进行理论分析,设计了一款用于时钟发生器的低功耗、宽调谐范围、低相位噪声锁相环。该锁相环采用了新型可编程、低调谐增益、低功耗的环形振荡器,达到了宽频率输出范围、低相位噪声、低功耗的目的,采用SMIC公司0.18um混合信号工艺,用Cadenced的Hspice仿真工具进行仿真,在1.8V电源电压供电情况下获得了50MHz~1.7GHz的频率锁定范围和1.8mW~2.3mW的较低功耗。单边带相位噪声在10KHz频偏处为-104dBc/Hz.。 相似文献