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101.
提出了一种基于新型算法SGLMS-CMA 的高速QAM均衡器. SGLMS-CMA 算法在stop-and-go原理指导下结合了经典CMA算法和DD-LMS算法. MATLAB仿真表明,与经典CMA算法相比,新型算法具有收敛速度快5倍,剩余MSE改善3~5dB,运算复杂度减少了82%,可纠正残留相偏的优点. 综合结果表明,采用SGLMS-CMA+DD-LMS的新型均衡器与CMA+DD-LMS均衡器相比,系统中均衡器模块的硬件开销只增加5%. 最后使用SMIC 0.18μm工艺库对新型均衡器进行综合,并且嵌入到QAM解调芯片中进行流片,最终测试结果表明新型均衡器性能优越. 相似文献
102.
Naohiko Shimada Ken Saito Takafumi Miyata Hiroki Sato Satoshi Kobayashi Atsushi Maruyama 《Advanced functional materials》2018,28(17)
The huge information storage capability of DNA and its ability to self‐assemble can be harnessed to enable massively parallel computing in a small space. DNA‐based logic gates are designed that rely on DNA strand displacement reactions; however, computation is slow due to time‐consuming DNA reassembly processes and prone to failure as DNA is susceptible to degradation by nucleases and under certain solution conditions. Here, it is shown that the presence of a cationic copolymer boosts the speed of DNA logic gate operations that involve multiple and parallel strand displacement reactions. Two kinds of DNA molecular operations, one based on a translator gate and one on a seesaw gate, are successfully enhanced by the copolymer without tuning of computing conditions or DNA sequences. The copolymer markedly reduces operation times from hours to minutes. Moreover, the copolymer enhances nuclease resistance. 相似文献
103.
传统的液压起货机存在效率低、噪音大、维护成本高等问题,难以满足现代节能环保的发展要求。变频液 压调速从源头上解决功率匹配问题,电机始终处在高效率的工作状态,避免了电机和液压泵的高速连续运 转,提高了设备的可靠性、使用寿命和能源利用率。本文提出在起货机上运用变频液压调速系统的设计方 案,并对其工作特性进行了分析。 相似文献
104.
105.
106.
107.
介绍了现代电子产品焊接质量的检测技术,以及用于检查焊点质量和组装板(SMA)功能的测试仪器的工作原理及测试能力.目前常见和广泛使用的焊接质量检测方法是人工目测检查,其主要问题是其主观性,只能用来检测电子元件的形状、尺寸、颜色、表面特征及焊点的外观质量;自动光学检测(AOI)可以在整个过程中发现和纠正缺陷,但只是外在的焊点缺陷;激光/红外线组合式检测系统、X射线检测系统可以分析焊点微米级水平的缺陷,能找出其他检测所不能可靠地发现的缺陷,包括空洞、焊点形状差和冷焊锡点等;另外,X射线检测系统能一次测试单面或双面电路,准确地定位缺陷,获取工艺参数,例如锡膏厚度等. 相似文献
108.
介绍了一种基于模拟电路仿真实验平台实现双闭环直流调速系统课程设计的方法,该方法利用计算机完成实验数据的采集、存储和计算处理,根据实验结果可以准确直观地分析转速一电流双闭环调速系统的起动过程及动态抗扰性能,可方便地设计各种不同的调节器参数及控制策略并分析其对系统性能的影响,取得了很好的教学效果。该方法亦可用于对其他类型自控系统的分析设计。 相似文献
109.
110.
An 8-bit, 200 MSPS Folding and Interpolating ADC 总被引:1,自引:0,他引:1
An 8-bit, 200 MSPS folding and interpolating analog-to-digitalconverter, ADC, has been implemented in a 1.2 µmBiCMOS-process. It achieves 7.5 effective bits with a power dissipationof 575mW. The active area is 4mm2. The implementationand measured results are presented. A simple analytical modelfor the interpolation-induced nonlinearity in a folding and interpolatingADC using sinusoidal folding is presented. The bowing of thereference ladder due to interaction with the input stages isanalyzed, and analytical models are derived. 相似文献