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51.
扇形浇口热流道注射成型PP方椅背靠 总被引:1,自引:0,他引:1
介绍了PP方椅背靠的形状,研究了扇形浇口热流道注射成型PP方椅背靠的模具结构及运行特征,分析了扇形浇口的设计。根据物料的性能特点,重点分析了模温系统的温控条件以及注射工艺条件对制品的影响。结果表明,按照提供的工艺条件进行调试,所生产的制品无任何流痕,飞边等其他缺陷,效果较为理想。 相似文献
52.
抽水蓄能电站事故闸门动水闭门可靠性及门体水力荷载特性一直是闸门设计和运行中的核心问题,本文通过数值模拟,对响水涧抽水蓄能电站上库进水口事故闸门在不同事故流量工况下动水闭门过程的门体水力荷载进行研究,并与模型试验结果进行比较分析,相同事故工况的数值计算成果和模型试验成果吻合较好,表明采用RNG k~ε模型和VOF方法对平面闸门动水关闭的非恒定流过程进行数值模拟能够取得较好的结果。数值模拟计算结果表明流道的过流量对事故闸门门体水力荷载影响显著,初始事故流量越大,闸门动水关闭过程中闸门区满流向明流过渡时刻的闸门相对开度越大,闸门上游底缘上托力越小,事故闸门动水闭门的持住力相应越大。事故流量由151 m~3/s增大至800 m~3/s时,闭门持住力增大约20%。计算分析结果可为相关闸门的设计和运行提供参考。 相似文献
53.
针对某山区高水头船闸30 m淹没水深下一字闸门的水动力特性进行研究,借助FLUENT软件提供的Realizable k-ε紊流模型对门体启闭过程非恒定流场进行动态模拟,通过建立由二维平面混合网格纵向拉伸成的三维棱柱体网格,结合2.5D重构和弹性光顺动网格法,在降低网格数量、提高计算效率的同时,实现一字闸门启闭全过程三维流场模拟。引入VOF法对自由水面迭代求解,得到一字闸门启闭过程门前后水位差及动水阻力矩变化规律,将计算结果与模型试验进行比较,两者吻合较好。模拟计算发现:门底间隙对闸门运行整个阶段动水阻力矩均有影响,动水阻力矩峰值随门底间隙增大而变小。 相似文献
54.
针对轴流泵机组起动过程的研究是泵站安全稳定运行研究的重要环节。为了准确捕捉轴流泵机组在起动过渡过程中的动态特性,建立轴流泵机组的全流道三维模型,采用三维CFD计算软件Fluent,利用基于有限体积法的动网格技术,配合VOF多相流模型对快速闸门断流的轴流泵机组起动过程进行了三维瞬态数值模拟,获得了轴流泵机组起动过渡过程中的流态变化及外特性参数的变化规律。闸门开启时间为60s时,机组起动扬程在12s时达到最大值2.76m,为运行扬程的1.28倍。减小快速闸门开启时间能够降低机组最大起动扬程,但同时会加剧回流及闸门处的水流撞击。计算结果表明:动网格技术结合VOF多相流模型可以较好的应用于快速闸门断流的轴流泵机组起动过渡过程数值模拟中,其结果可为泵站水力设计及轴流泵机组的过渡过程研究提供参考。 相似文献
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56.
57.
为了优化步进电机开环控制性能,对非零速启停的加减速曲线算法及其低功耗硬件逻辑实现进行了研究。针对零速启停的加减速曲线存在控制性能难以充分发挥的问题,提出了一种非零速启停的步进电机线性加减速曲线算法,将加减速过程划分为四种转动模式,可构建任意的线性速度剖面。首先理论推导了四种加减速转动模式的控制脉冲周期;其次结合流水线设计思想优化加减速曲线算法的硬件逻辑模型,在FPGA中设计了步进电机控制器IP核,并采用门控时钟等低功耗IC设计技术实现了IP核的低功耗;最后,搭建了实验平台进行验证。实验结果表明,IP核可以实现四种转动模式的非零速启停控制,实现了高实时、高精度驱动,提升了20%的控制性能,电路面积优化约30%,功耗降低53%,验证了方案的可行性与有效性。 相似文献
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59.
Application of quantum-dot is a promising technology for implementing digital systems at nano-scale. QCA supports the new devices with nanotechnology architecture. This technique works based on electron interactions inside quantum-dots leading to emergence of quantum features and decreasing the problem of future integrated circuits in terms of size. In this paper, we will successfully design, implement and simulate a new full adder based on QCA with the minimum delay, area and complexities. Also, new XOR gates will be presented which are used in 8-bit controllable inverter in QCA. Furthermore, a new 8-bit full adder is designed based on the majority gate in the QCA, with the minimum number of cells and area which combines both designs to implement an 8-bit adder/subtractor in the QCA. This 8-bit adder/subtractor circuit has the minimum delay and complexity. Being potentially pipeline, the QCA technology calculates the maximum operating speed. 相似文献
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