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41.
混合集成电路DPA分析过程中的要点探讨 总被引:1,自引:0,他引:1
鲍恒伟 《电子产品可靠性与环境试验》2010,28(6):37-41
结合了混合集成电路(HIC)破坏性物理分析(DPA)的全过程,通过对DPA各项试验的特点进行分析,从而对DPA标准中规定的一些要求和难点问题进行了补充说明,尤其对一些试验如X射线检查、多余物检测、键合强度和扫描电子显微镜检查等的具体实施方法提出了独特的见解。 相似文献
42.
改革模拟实验教学和考试方法的尝试 总被引:6,自引:4,他引:6
模拟电子线路实验课对于电子线路教学改革和提高学生的工程实践能力具有重要作用。本文阐述了模拟实验课单独设课后教学及考试方法的改革尝试以及教学体会和教学效果。 相似文献
43.
Seiji Funaba Akihiro Kitagawa Toshiro Tsukada Goichi Yokomizo 《Analog Integrated Circuits and Signal Processing》2000,25(3):299-307
In this paper, we present an efficient approach for technology scaling of MOS analog circuits by using circuit optimization techniques. Our new method is based on matching equivalent circuit parameters between a previously designed circuit and the circuit undergoing redesign. This method has been applied to a MOS operational amplifier. We were able to produce a redesigned circuit with almost the same performance in under 4 h, making this method 5 times more efficient than conventional methods. 相似文献
44.
触摸屏控制器简化了对触摸屏的控制,但他采用串行通信,这样触摸屏控制器的转换精度越高,从他读出触摸点坐标值所花的时间就越多。为了减少这种时间,以一个基于StrongARM SA1100的嵌入式系统应用实例介绍了一种典型的电阻式触摸屏并行通信硬件驱动电路以及在此基础上的软件驱动程序设计方法和流程。有利于操作系统对触摸屏的控制。 相似文献
45.
46.
47.
The design and analog VLSI implementation of a recurrent neural network with integrated temporal learning is presented. The learning algorithm is forward in time, and is implemented strictly as instantaneous, local weight updates. PSpice simulations of networks with 4 to 6 neurons demonstrate robust learning of trajectory generation and classification tasks. A scalable 2-D VLSI architecture is described and a prototupe 4-neuron recurrent neural network with learning has subsequently been fabricated in MOSIS TinyChip 2 micron technology. Experimental results of the chip validate the learning performance with convergence in the millisecond range. Specific experimental results of learning circular and figure-8 dynamic trajectories are included. 相似文献
48.
Jing Xu Ray Siferd Robert L. Ewing 《Analog Integrated Circuits and Signal Processing》1999,20(3):193-201
Unique designs for CMOS analog arithmetic circuits are presented which perform addition (V1 + V2), subtraction (V2 – V1), add/invert –(V1 + V2), and multiply (V1 × V2). The circuit operation is based on the inherent square law of MOS transistor drain current when operating in the saturation region. Key features include: good linearity and accuracy, single ended voltage inputs and output, wide input and output range and no input bias voltages. The circuits can be directly coupled (no buffer) and serve as basic building blocks for analog signal processing implementations such as analog filters and adaptive equalizers. All circuits were implemented in 1.2 m CMOS technology. 相似文献
49.
50.
数字电视技术的发展和最新进展 总被引:1,自引:0,他引:1
一个有着巨大市场的数字电视市场等待开发,而且政府部门还制定了数字电视转换时间表以大力推动,几年时间,数字电视概念在中国掀起数次浪潮,在探讨数字电视核心竞争力的基础上,从数字电视技术的发展角度出发,对数字电视技术的最新进展作一综述。 相似文献