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61.
耐久性试验是批次检验汽车起动机质量的一种重要方法.结合汽车起动机耐久性试验的特点,给出实现PLC控制的汽车起动机耐久性试验系统.该系统能对多台汽车起动机进行同时试验,做到准确控制汽车起动机的耐久性试验周期,具有良好的人机交互界面.实际运行稳定可靠,充分保证了汽车起动机的出厂质量. 相似文献
62.
选择性加氢裂化技术可以由劣质催化裂化柴油(催化柴油)最大量生产高辛烷值汽油组分,同时还可以生产低硫清洁柴油调合组分,实现劣质催化柴油高效转化。利用现有装置改造为催化柴油加氢裂化装置是推广该技术的有效途径。研究表明,利用柴油加氢精制装置改造为催化柴油加氢裂化装置主要限制因素在于产品分布和工艺参数的巨大差距,需较大幅度降低装置处理量,改造工程量较大;利用中压加氢裂化装置改造为催化柴油加氢裂化装置,产品分布和工艺参数的差距相对较小,改造工程量较小。各炼厂可根据具体情况选择适宜装置进行相应改造,实现催化柴油高效转化。 相似文献
63.
The start gene CDC28 and the genetic stability of yeast 总被引:2,自引:0,他引:2
A B Devin V T Prosvirova TYuPeshekhonov O V Chepurnaya M E Smirnova N A Koltovaya E N Troitskaya I P Arman 《Yeast (Chichester, England)》1990,6(3):231-243
The cdc28-srm mutation in Saccharomyces cerevisiae decreases spontaneous and induced mitochondrial rho- mutability and the mitotic stability of native chromosomes and recombinant circular minichromosomes. The effects of cdc28-srm on the genetic stability of cells support the hypothesis that links cell cycle regulation in yeast to changes in chromatin organization dependent on the start gene CDC28 (Hayles and Nurse, 1986). 相似文献
64.
提出了一种采用单比较器变步长反馈控制和占空比抖动方法的数字DC- DC变换模块.它用6位二进制分辨率占空比的PWM信号实现了7位的电压分辨率.变步长反馈控制的使用使得它具有比恒定步长方案更好的动态性能,而且没有过多增加控制器的复杂度.在1MHz的开关频率下,控制器自身功耗小于0 .5 m W(不含功率开关及驱动部分) .由于电路的模拟部分极少,因此易与数字系统进行单芯片集成. 相似文献
65.
采用TL494、SN75172等元件组成了Diamond K-250射频气体激光调制器,调制频率、占空比和调制度单儿可调。分析了电路的工作原理,给出了调制频率,占空比所对应的激光输出功率曲线。 相似文献
66.
利用m-序列的伪随机特性与正态分布理论的优势统计方法,提出了一种用线性反馈移位寄存器生成的具有一定误码率的二元序列的反馈多项式还原方法,对通常所用的Berlekamp-Massey算法是一个补充,在一定范围内具有良好的实用价值。 相似文献
67.
68.
69.
在某些情况下斯特林制冷机采用间歇式工作方式,以延长卫星在太空中的服务年限,因此由斯特林机致冷的低温半导体器件如HgCdTe中长波红外探测器会经受成千上万次从-173℃以下到常温的温度循环,这个过程可能会造成器件的失效.为了研究器件的失效机理和可靠性,帮助筛选器件,本文介绍了一种自制新型的温度循环实验设备,型号TCE-a.经过数千次温度循环,设备满足器件筛选实验要求. 相似文献
70.
A clock generator circuit for a high-speed high-resolution pipelined A/D converter is presented.The circuit is realized by a delay locked loop(DLL),and a new differential structure is used to improve the precision of the charge pump.Meanwhile,a dynamic logic phase detector and a three transistor NAND logic circuit are proposed to reduce the output jitter by improving the steepness of the clock transition.The proposed circuit,designed by SM1C 0.18μm 3.3 V CMOS technology,is used as a clock generator for a 14 bit 100 MS/s pipelined ADC.The simulation results have shown that the duty cycle ranged from 10%to 90%and can be adjusted.The average duty cycle error is less than 1%.The lock-time is only 13 clock cycles.The active area is 0.05 mm2 and power consumption is less than 15 mW. 相似文献