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介绍了咬尾卷积码的最优和次最优译码算法的实现细节,给出了采用新的蝶形图计算方法和环形内存来节省硬件资源的实现方法,最后给出了次最优算法在FPGA上的实现结果。 相似文献
62.
基于FPGA的Viterbi译码器设计 总被引:2,自引:0,他引:2
卷积码及其Viterbi译码是现代通信系统中常用的一种信道编码方法。文中介绍了Viterbi译码算法的原理,分析了Viterbi译码器的结构,然后用Verilog语言设计了一种基于Altera公司EP3C120F780C8芯片的(2,1,7)Viterbi译码器,同时给出了时序仿真图。 相似文献
63.
信道编码是数字通信系统中的重要组成部分,它是保证信号可靠传输的一种重要方式,卷积码以其优越的性能被广泛应用在数字通信系统中。结合无人机信道的特性,研究分析了卷积码的性能特征,选定了适合无人机数据链特性的(2,1,2)卷积码,采用硬件描述语言实现了卷积码编译码器的硬件设计。实验结果表明,在纠错能力范围内,该设计方案能够正确纠错并译码,并且具有较高的译码速率,提高了无人机数据链的通信质量和抗干扰性能。 相似文献
64.
Four types of variable-rate convolutional network codes are investigated over a single-source finite cyclic network.It is found that variable-rate generic,dispersion and broadcast can be implemented on the same network without changing the local encoding kernels of the non-source nodes.The efficient implementation has the advantage that each non-source node only needs to store one copy of the local encoding kernel within a session.However,it is also shown by an example that variable-rate multicast may not always be implemented under the above condition. 相似文献
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针对TDMA宽带无线接入系统零星误码的问题,设计了7/8自正交卷积码高效结构的编码器和反馈结构的译码器,7/8自正交卷积码的应用使得宽带无线接入系统的误码性能得到较大改善。针对解调器相位模糊和译码器失步的问题,提出了统一的解决方案,应用该方案可获得3dB的功率增益,而且可快速地获得译码器和编码器之间的同步。 相似文献
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