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为满足全方位视觉运动目标检测跟踪系统中检测和跟踪实时性的要求,采用多核程序设计和并行处理技术,对系统中连通域标记算法,重新进行了设计和实现。为解决由图像分割造成的连通域的分离,应用边界处的游程码,将两个不同任务块中分割处的连通域合并成一个连通域。最后通过实验证明该并行算法比传统算法在多核处理器上运行更快,更好地解决了多核处理器饥饿问题,让多核处理器发挥了更高的效率。 相似文献
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对单片机数据通信网络物理结构进行改进,实现多机自主通信。以单片机串行口为基础,实现数据通信的容错技术。针对目前数据通信调控系统通信部分存在的干扰问题,采用汉明码纠错技术对发送和接收数据进行纠错校正。将繁杂的汉明码算法简单化,便于程序编程的实现。为了不影响通信的速率和系统的实时性,采用查表的方式对汉明码进行编程。 相似文献
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物联网是互联网与嵌入式系统发展到高级阶段以后的完美融合,具有20多年物联网史的嵌入式系统,是物联网技术的重要组成部分。本文从嵌入技术和嵌入式处理器入手,并阐述了嵌入式技术在物联网中的作用及发展前景。 相似文献
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在视频编解码领域,随着视频图像分辨率的提高,对处理平台的计算能力、存储、传输带宽的需求急剧增加.为满足高分辨率视频编解码对处理平台的巨大性能需求,本文结合流处理器在媒体处理上的独特优势以及FPGA灵活的可配置性,构建了一个由流处理器和FPGA组成的可配置异构多处理器平台.为了对平台进行性能测试,将MOTION JPEG... 相似文献
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集成电路制造工艺的飞速发展,使得集成电路的特征尺寸不断减少和集成度不断提高,造成集成电路对工作环境的影响越来越敏感,发生软错误的几率不断增加,对可靠性造成重要影响。随着微处理器进入了多核时代,丰富的片上资源给软错误加固带来了很好的机遇。本文针对多核处理器中I/O系统软错误,提出了一种基于多核处理器的软件Scrub方法对软错误进行加固。测试结果表明,我们提出的软错误容错方法可以大大提高I/O系统的可靠性。 相似文献
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介绍网络多核处理器OCTEON和基于OCTEON开发的基本需求,讨论在Linux平台下基于该芯片开发高精度流回放系统的设计与实现过程,包括主机与OCTEON间PCI的通信,高精度流回放的时间戳实现,以及多个流同时回放的设计与实现。对该系统的性能测试表明,基于OCTEON的流回放实现高度并行并且高精度的处理,系统的实现对于在高速Gbps环境下的网络数据流检测、过滤与入侵检测系统具有很高的应用价值。 相似文献
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介绍了数据采集系统终端中人机接口硬件电路的设计,详细提供了液晶显示器和触摸屏模块的设计电路。通过具体分析人机交互的工作原理,采用三星公司开发的一款以ARM920T为核心的16/32位嵌入式处理器S3C2410为开发平台,该处理器主要面向终端设备以及高性价比、低功耗的开发应用。拥有亮度高、体积小、功耗低等优势的液晶显示器以及使用方便、操作简单的触摸屏被广泛应用于数据采集系统中。 相似文献
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Hamid Noori Farhad Mehdipour Kazuaki Murakami Koji Inoue Morteza Saheb Zamani 《The Journal of supercomputing》2008,45(3):313-340
To improve the performance of embedded processors, an effective technique is collapsing critical computation subgraphs as
application-specific instruction set extensions and executing them on custom functional units. The problem with this approach
is the immense cost and the long times required to design a new processor for each application. As a solution to this issue,
we propose an adaptive extensible processor in which custom instructions (CIs) are generated and added after chip-fabrication.
To support this feature, custom functional units are replaced by a reconfigurable matrix of functional units (FUs). A systematic
quantitative approach is used for determining the appropriate structure of the reconfigurable functional unit (RFU). We also
introduce an integrated framework for generating mappable CIs on the RFU. Using this architecture, performance is improved
by up to 1.33, with an average improvement of 1.16, compared to a 4-issue in-order RISC processor. By partitioning the configuration
memory, detecting similar/subset CIs and merging small CIs, the size of the configuration memory is reduced by 40%. 相似文献
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