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81.
薄膜全耗尽CMOS/SOI—下一代超高速Si IC主流工艺 总被引:3,自引:0,他引:3
本文较为详细地分析了薄膜全耗尽CMOS/SOI技术的优势和国内外TF CMOS/SOI器件和电路的发展状况,讨论了SOI技术今后发展的方向,得出了全耗尽CMOS/SOI成为下一代超高速硅集成电路主流工艺的结论。 相似文献
82.
SIMOX技术是最具有发展前途的SOI技术之一。在发展薄硅层、深亚微米OMOS/SOI集成电路中,SIMOX技术占有极其重要的地位。本文综述了SIMOX基片的形成、高质量SIMOX基片的制备方法。阐述了薄硅层OMOS/SIMOX器件的工艺特点以及器件的性能特点。本文也就SIMOX技术及GMOS/SIMOX器件的研究现状及发展趋势进行了讨论。 相似文献
83.
84.
在表层硅厚度为180um的SIMOX材料上,用局部增强氧化隔离等工艺研制了沟道长度为2.5μm的全耗尽CMOS/SIMOX器件。该工艺对边缘漏电的抑制及全耗尽结构对背沟漏电的抑制降低了器件的整体漏电水平,使PMCOS和NMOS的漏电分别达到3.O×10-11A/μm和2.2×10-10A/μm。5V时,例相器的平均延迟时间达6ns。 相似文献
85.
86.
介绍了采用全剂量SIMOX SOI材料制备的0.8μm SOI CMOS器件的抗总剂量辐射特性,该特性用器件的阈值电压、漏电流和专用集成电路的静态电流与高达500krad(Si)的总剂量的关系来表征.实验结果表明pMOS器件在关态下1Mrad(Si)辐射后最大阈值电压漂移小于320mV,nMOS器件在开态下1Mrad(Si)辐射后最大阈值电压漂移小于120mV,器件在总剂量1Mrad(Si)辐射后没有观察到明显漏电,在总剂量500krad(Si)辐射下专用集成电路的静态电流小于5μA. 相似文献
87.
300门CMOS/SIMOX门阵列容错ASIC电路的研制 总被引:1,自引:0,他引:1
本文简要地介绍了3μmCMOS/SIMOX门阵列的设计和制作技术。利用300门门阵列母片成功地实现了容错计算机系统专用总线输出选择逻辑电路SEL。其性能达到了用户要求,平均单级门延迟时间为2.6ns,输出驱动电流为2.4mA. 相似文献
88.
The hot-carrier-induced oxide regions in the front and back interfaces are systemati-cally studied for partially depleted SOI MOSFET's. The gate oxide properties are investigated forchannel hot-carrier effects. The hot-carrier-induced device degradations are analyzed using stressexperiments with three typical hot-carrier injection, i.e., the maximum gate current, maximumsubstrate current and parasitic bipolar transistor action. Experiments show that PMOSFET's 相似文献
89.
SIMOX材料注F+后的SIMS分析 总被引:1,自引:0,他引:1
实验中采用三种剂量注入SIMOX材料中,注入剂量分别为5×10^12F^+/cm*^2,5×10^13F^+/cm^2,1×10^5F^+/cm^2,用SIMS技术了F在材料中的浓度分析,结果表明,随着注F^+能量和剂量的改变,F^+在材料中的深度分布也相应改变。 相似文献
90.
SIMOX薄膜材料的红外光谱特性和薄膜厚度的非破坏性测量方法 总被引:1,自引:0,他引:1
报道了 SOI材料薄膜厚度的非破坏性快速测量方法 ,详细地研究了 SIMOX材料的红外吸收光谱特性 ,求出了特征峰对应的吸收系数 .提出利用红外吸收光谱测量 SIMOX绝缘埋层厚度的非破坏性方法 ,并根据离子注入原理计算出表面硅层的厚度 .SIMOX薄膜的表层硅和绝缘埋层的厚度是 SOI电路设计时最重要的两个参数 ,提供的非破坏性测量方法 ,测量误差小于5% .在 SIMOX材料开发利用、批量生产中 ,用此方法可及时方便地检测 SIMOX薄膜的表层硅和绝缘埋层的厚度 ,随时调整注入能量和剂量 相似文献