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1.
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3.
采用等离子熔覆法在Mn13高锰钢上制备了低碳Fe-Ni合金层。以熔覆电流、喷头移动速率、离子气流量和热处理温度作为输入参数,以冲击韧性作为输出参数,建立了BP(误差反向传播)神经网络模型和粒子群算法优化(PSO)BP神经网络模型,并跟冲击韧性与热处理温度之间的线性回归模型进行对比。结果表明,线性回归模型、BP神经网络模型和PSO-BP模型的平均相对误差分别为7.06%、6.12%和3.03%。PSO-BP模型的预测结果与实测值的误差较小。 相似文献
4.
响应面法优化固定化碱性蛋白酶工艺 总被引:2,自引:0,他引:2
采用多孔壳聚糖微球吸附和戊二醛交联的方法,将碱性蛋白酶固定于壳聚糖上.在pH、加酶量、温度、戊二醛体积分数和固定化时间5个单因素试验的基础上,利用响应面分析法对固定化碱性蛋白酶的工艺条件进行了优化.结果表明:在pH 9.20、加酶量7 512 U/g、固定化温度44.58℃、戊二醛体积分数0.20%、固定化时间8.11 h的最佳工艺条件下,酶的回收率高达56.73%. 相似文献
5.
为了解决图像检索中聚类问题,对图像作双树旋转复小波变换,再对变换后的系数通过广义高斯模型建模后,计算Kullback-Leibler距离;对图像采用局部二值模式,计算图像之间的对数似然距离.将这2种距离采用事先计算得到的加权因子进行融合得到新的距离.在此距离的基础上构建邻接矩阵,对邻接矩阵采用谱聚类的方法进行聚类运算.实验证明,由于双树旋转复小波变换和局部二值模式之间存在互补性,在聚类过程中将2种特征距离结合起来,能够有效地提高聚类的正确性. 相似文献
6.
以国际合作项目毛里求斯机场和利比亚于宅设计工作为例,介绍了作者近几年来参与国际EPC(Engineer Procure Construct)建设项目设计工作的体验,分析了EPC设计工作特点,以及在国际EPC项目设计和设计管理工作中遇到的有关问题和应对措施.认为:采用EPC项目承包管理模式,对项目建设的进度、质量和投资进行监督管理,可提高工作效率,减少管理成本;此外,还要求设计人员要有良好的职业素质、扎实的专业功底和良好的沟通能力,不仅要了解国际EPC项目设计工作的特点,还要适应设计环境,积极主动的开展设计工作,才能满足合同设计要求. 相似文献
7.
乔治50岁的时候就死了,死后他见到了上帝,他向上帝诉苦:“主啊,我在世上活了50年,您连一次飞黄腾达的机会都没有给我,因为没机会,我平庸地度过了一生。” 相似文献
8.
为了获得各种丰富和逼真的皮肤图像,在对皮肤结构和皮肤组成进行分析的基础上,提出了一种基于物理模型的鲁棒算法对输入的单张皮肤图像自动进行色素分离,并在此基础上实现了全局性和局部性的合成。输入的图像首先被分成N个子区域,并依次在每个子区域利用ICA算法提取分离向量,之后对得到的分离向量进行合理性验证。如果分离向量不合理,则丢弃,在下一个子区域重复上述过程。最后,从所有的合理分离向量中得到最终的分离向量,分离得到黑色素和血色素的密度分布图。通过改变色素的密度可以进行全局性合成,也可以利用密度信息选取感兴趣区域进行局部性合成。实验结果表明,该算法非常有效,可以对人体皮肤图像进行"电子化妆",重新生成更多逼真的合成图像。 相似文献
9.
针对脱硫系统运行优化过程中脱硫效率回归模型精度不够,及运行优化方案在实际运行中难以有效执行的问题。该文提出一种基于信息物理融合和XGBoost-MPGA的脱硫系统运行优化方法。通过构建XGBoost脱硫效率回归模型作为脱硫变动成本函数的变量,利用MPGA寻找脱硫变动成本最低时对应的脱硫效率,然后逆向求解出脱硫效率回归模型中液气比、吸收塔浆液pH值、吸收塔液位优化值。通过实例分析表明,XGBoost-MPGA相比BP神经网络、随机森林和GBRT回归模型具有更好的预测性能,且与XGBoost-SGA比较,在脱硫变动成本极值寻优过程具有更好的稳定性和收敛性。并通过信息物理融合方法消除了脱硫物理设备在运行优化操作后对脱硫变动成本信息的影响,提高了运行优化操作方案的可靠性和经济性。 相似文献
10.
舒畅郭裕顺 《微电子学与计算机》2022,(12):100-106
芯片间数据传输速率的不断提高,导致系统对时钟信号的要求越来越高.延迟锁相环在各种高速通信系统中提供多相位时钟,其相位精度直接影响到数据的误比特率.然而,因鉴相器器件失配引起的相位误差问题在时钟频率提高的同时愈发明显.针对一种基于OTA的延迟锁相环电路鉴相器失配问题,提出了一种环路自校准方案,同时给出校准电路的Verilog-A行为级模型.当鉴相器中两个或门电路之间存在失配误差时,将会在OTA输入端以失调电压的形式引起输出相位偏移;校准电路能够对该失调电压实现检测与计算,并补偿至环路中,使得理想反馈时钟条件下,OTA输入端电压保持相同,压控延迟线延时不再改变,最终能够有效减小因鉴相器失配引起的输出时钟相位误差.基于TSMC 40nm CMOS工艺完成了4相DLL电路的设计,其工作频率范围能够达到10 GHz~12 GHz;联合校准电路模型,通过电路-模型混合仿真结果显示:校准前后,输出时钟相位误差均方值从300fs降低至30fs. 相似文献