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Viterbi译码中的路径度量存储管理 总被引:2,自引:0,他引:2
大约束度卷积码的Viterbi译码器硬件复杂度大,限制了其速度。该文分析了Viterbi译码器的结构,从路径度量存储管理着手,合理地组织了存储器结构,简化了ACS和度量存储器之间的接口电路。提高了译码速率,使译码器便于FPGA实现。 相似文献
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基于置乱与融合的数字图像隐藏技术及其应用 总被引:1,自引:0,他引:1
基于数字图像的置乱与融合,提出一种新数字图像隐藏方法.对多幅数字图像采用先融合后置乱的处理,然后再基于DCT变换把置乱后的混合图像嵌入到公开图像之中.数值实验表明,所给方法实现简便,并且具有一定程度的鲁棒性. 相似文献
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高速Viterbi译码器的优化和实现 总被引:1,自引:0,他引:1
大约束度卷积码作为信道纠错编码在通信中得到了广泛的应用,而其相应的Viterbi译码器硬件复杂度大,限制了译码速度。分析了Viterbi译码器的结构,优化了各模块,合理地组织了存储器结构,简化了接口电路。用FPGA实现Viterbi译码器,提高了译码器速度。 相似文献
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