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Turbo Code译码算法的硬件实现 总被引:1,自引:0,他引:1
并行级联卷积码迭代译码算法(TurboCode)有着非常强的纠错译码能力。但大量的运算给工程实现TC译码器带来相当难度。文章在对MAP软输入软输出算法充分仿真基础上,给出一种简化MAP算法的Turbo译码器方案,此方案适用于FPGA器件实现。 相似文献
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