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1.
为了能够容忍单粒子多节点翻转,提出了一种新颖的三模互锁加固锁存器。该锁存器使用具有过滤功能的代码字状态保存单元(CWSP)构成三模互锁结构,并在锁存器末端使用CWSP单元实现对单粒子多节点翻转的容错。HSPICE仿真结果表明,相比于三模冗余(TMR)锁存器,该锁存器功耗延迟积(PDP)下降了58.93%;相比于容忍多节点翻转的DNCS-SEU锁存器,该锁存器的功耗延迟积下降了41.56%。同时该锁存器具有较低的工艺偏差敏感性。 相似文献
2.
3.
FH4-060型高分辨堆积拒绝门 总被引:1,自引:1,他引:0
金余恒 《核电子学与探测技术》1984,(1)
本文介绍一种用于快闪烁探测器能谱测量系统的堆积拒绝门,其分辨时间好于10ns。线路采用更新计时器,定时电容的更新时间包含在门宽度之内,原则上电路无死时间,输入计数率无上限,特别适用于高计数率的场合。电路内附反符合控制输入和门信号放大器,可实现对多道分析器的堆积拒绝和反符合控制。 相似文献
4.
5.
《Planning》2014,(2)
本文介绍一种基于8D锁存器74LS373设计的能区分选手抢答是否犯规的数字抢答器,并详细阐述了其工作原理和硬件电路结构。通过测试结果表明,运用该方案设计的数字抢答器,具有结构简单、操作方便、易于实现、区分度高、实用性强等优点。 相似文献
6.
随着集成电路工艺水平的不断提高、器件尺寸的不断缩小以及电源的不断降低,传统的锁存器越发容易受到由辐射效应引起的软错误影响。为了增强锁存器的可靠性,提出了一种适用于低功耗电路的自恢复SEU加固锁存器。该锁存器由传输门、反馈冗余单元和保护门C单元构成。反馈冗余单元由六个内部节点构成,每个节点均由一个NMOS管和一个PMOS管驱动,从而构成自恢复容SEU的结构。在45 nm工艺下,使用Hspice仿真工具进行仿真,结果表明,与现有的加固方案FERST[1]结构相比,在具备相同面积开销和单粒子翻转容忍能力的情况下,提出的锁存器不仅适用于时钟门控电路,而且节省了61.38%的功耗-延迟积开销。 相似文献
7.
局部总线接口是P2020处理器应用场景较多的接口之一,为了节省芯片管脚数量,P2020芯片对局部总线进行了地址数据管脚复用,因此,硬件需要设计锁存器来区分地址和数据信号.当使用FPGA实现锁存器功能时,如果不考虑FPGA布线带来的时序误差,容易出现锁存地址出错的情况,文章通过分析P2020处理器局部总线锁存功能,结合逻... 相似文献
8.
采用TSMC 1.18 μm标准CMOS工艺实现了一种4:1分频器.测试结果表明,电源电压1.8 V,核心功耗18 mW.该分频器最高工作频率达到16 GHz.当单端输入信号为-10 dBm时,具有5.8 GHz的工作范围.该分频器可以应用于超高速光纤通信以及其它高速数据传输系统. 相似文献
9.
Michael Day 《电子设计技术》2010,(1):54-54,56
从高端视频显示器到低端的照明,LED在很多领域得到了应用。设计者经常只需要一个专用LED驱动器功能的一部分,但不能承受用微控制器进行控制的成本。微处理器一般用于控制专用LED驱动器,实现例如对LED电流的模拟或PWM(脉冲 相似文献
10.
提出了一种大电流16位稳态电流LED驱动器的ASIC设计方案,并描述了芯片的主要功能原理。对各个模块的主要电路进行了分析和设计,数字部分电路依靠成熟的FPGA平台验证,最大程度提高了电路可靠性;模拟部分电路通过分析和计算,确定不同参数,最后对整个方案进行了仿真。这种16位稳态电流LED驱动芯片可以完成对点阵LED显示屏的驱动,芯片外围电路简单、成本低、可靠性高。该芯片也适用于点阵LED屏等LED设备的驱动,应用十分广泛。芯片方案的各个部分都给出了详细的仿真结果,整个方案最后通过了T-Spice后仿真。 相似文献