| 高速CMOS预放大-锁存比较器设计 |
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| 引用本文： | 宁宁,于奇,王向展,任雪刚,李竞春,唐林,梅丁蕾,杨谟华.高速CMOS预放大-锁存比较器设计[J].微电子学,2005,35(1):56-58,62. |
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| 作者姓名： | 宁宁 于奇 王向展 任雪刚 李竞春 唐林 梅丁蕾 杨谟华 |
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| 作者单位： | 1. 电子科技大学,微电子与固体电子学院,四川,成都,610054
2. 上海力通微电子有限公司,上海,200233 |
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| 基金项目： | 国家自然科学基金项目(60072004)
模拟集成电路国家重点实验室基金资助项目(51439010303DZ0221) |
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| 摘 要： | 基于预放大-锁存理论，提出了一种带1级预放大器的高速CMOS锁存比较器电路拓扑结构；阐述了其传输延迟时间、回馈噪声和输入失调电压的改进方法。采用典型的0．35μm／3．3V硅CMOS工艺模型，通过Cadence进行模拟验证，得到其传输延迟时间380ps，失调电压6．8mV，回馈噪声对输入信号产生的毛刺峰峰值500μV，功耗612μw。该电路的失调电压和回馈噪声与带两级(或两级以上)CMOS预放大锁存比较器的指标相近，且明显优于锁存比较器。其功耗和传输延迟时间介于两种比较器之间．该电路可用于高速A／D转换器模块与IP核设计。
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| 关 键 词： | 预放大锁存器 锁存比较器 高速比较器 传输延迟 回馈噪声 |
| 文章编号： | 1004-3365(2005)01-0056-03 |
Design of a High Speed CMOS Preamplifier-Latch Comparator |
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| NING Ning,YU Qi,WANG Xiang-zhan,REN Xue-gang,LI Jing-chun,TANG Lin,MEI Ding-lei,YANG Mo-hua.Design of a High Speed CMOS Preamplifier-Latch Comparator[J].Microelectronics,2005,35(1):56-58,62. |
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| Authors: | NING Ning YU Qi WANG Xiang-zhan REN Xue-gang LI Jing-chun TANG Lin MEI Ding-lei YANG Mo-hua |
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| Abstract: | |
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| Keywords: | Preamplifier-latch Latch comparator High-speed comparator Propagation delay Kick-back noise |
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