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一个10位、50MS/s CMOS折叠流水结构A/D转换器
引用本文:李志刚,石寅,于云华,刘扬. 一个10位、50MS/s CMOS折叠流水结构A/D转换器[J]. 半导体学报, 2004, 25(6): 720-725
作者姓名:李志刚  石寅  于云华  刘扬
作者单位:中国科学院半导体研究所,北京,100083;中国科学院半导体研究所,北京,100083;中国科学院半导体研究所,北京,100083;中国科学院半导体研究所,北京,100083
基金项目:国家高技术研究发展计划(863计划)
摘    要:在 0.6μmDPDM标准数字CMOS工艺条件下 ,实现 10位折叠流水结构A/D转换器 ,使用动态匹配技术 ,消除折叠预放电路的失调效应 ;提出基于单向隔离模拟开关的分步预处理 ,有效压缩了电路规模 ,降低了系统功耗 .在5V电源电压下 ,仿真结果为 :当采样频率为50MSPS时 ,功耗为 12 0mW ,输入模拟信号和二进制输出码之间延迟为2.5个时钟周期 ,芯片面积 1.44mm2 .

关 键 词:A/D转换器  CMOS模拟集成电路  折叠插值  失调  动态匹配  单向隔离模拟开关
文章编号:0253-4177(2004)06-0720-06
修稿时间:2003-05-29

A 10-bit 50-MS/s CMOS Pipelined Folding A/D Converter
Li Zhigang,Shi Yin,Yu Yunhua and Liu Yang. A 10-bit 50-MS/s CMOS Pipelined Folding A/D Converter[J]. Chinese Journal of Semiconductors, 2004, 25(6): 720-725
Authors:Li Zhigang  Shi Yin  Yu Yunhua  Liu Yang
Abstract:
Keywords:analog-to-digital converter  CMOS analog integrated circuit  folding and interpolation  offset  dynamic element matching  single-way analog switch
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