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用VHDL设计CRC发生器和校验器
引用本文:
井海明,高占凤.用VHDL设计CRC发生器和校验器[J].中国有线电视,2004(4).
作者姓名:
井海明
高占凤
摘 要:
用VHDL设计了一个在数字传输中常用的校验、纠错模块--循环冗余校验CRC模块,完成数据传输中的差错控制.通过时序仿真波形可看出,当输入12位信息位时,通过CRC发生器和校验器,可得到准确的输出.
关 键 词:
VHDL
数字传输
差错控制
CRC
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