| 基于DSP与CPLD的逻辑分析仪设计 |
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| 引用本文： | 王晓东. 基于DSP与CPLD的逻辑分析仪设计[J]. 现代电子技术, 2006, 29(5): 92-94 |
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| 作者姓名： | 王晓东 |
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| 作者单位： | 浙江工业大学,信息工程学院,浙江,杭州,310014 |
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| 摘 要： | 逻辑分析仪主要功能是分析测量数字系统的逻辑波形和逻辑关系。该设计采用了一个DSP芯片对8路数字信号进行高速采样,一个CPLD芯片控制示波器接口电路,以及一个双口RAM协调DSP和CPLD之间数据传输。逻辑信号按照预先设计的触发条件在特定时间段内采集。在CPLD里设计了一个具有28个状态的状态机来实现数据通道显示、时间线显示和触发位置显示。8路数字信号同时在示波器显示屏上显示,可以让用户比较直观地分析8路数字信号的相对关系。该设计最高可采集的数字信号在1MHz左右,允许设置1～3级的触发条件,并可以进一步扩展功能,非常适合数字系统实验和数字电路设计的需要。详细分析和介绍了该系统的软硬件设计和实现。
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| 关 键 词： | DSP CPLD 示波器 逻辑分析仪 |
| 文章编号： | 1004-373X（2006）05-092-03 |
| 收稿时间： | 2005-12-28 |
| 修稿时间： | 2005-12-28 |
A Design of Digital Logic Analyzer Based on DSP and CPLD |
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| WANG Xiaodong. A Design of Digital Logic Analyzer Based on DSP and CPLD[J]. Modern Electronic Technique, 2006, 29(5): 92-94 |
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| Authors: | WANG Xiaodong |
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| Affiliation: | College of Information Engineering,Zhejiang University of Technology, Hangzhou,310014 ,China |
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| Abstract: | |
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| Keywords: | DSP CPLD oscilloscope digital logic analyzer |
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