| 高速VITERBI译码器的研究与设计 |
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| 引用本文： | 李庆,李选中,江汉红,何文浩.高速VITERBI译码器的研究与设计[J].微电子学与计算机,2009,26(1). |
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| 作者姓名： | 李庆 李选中 江汉红 何文浩 |
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| 作者单位： | 1. 武汉理工大学 信息工程学院,湖北 武汉,430070
2. 海军工程大学,电气工程系,湖北 武汉 430033 |
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| 摘 要： | 设计了一个高速(2,1,6)Viterbi译码器,通过采用并行基-4结构和比特级进位保存算法(Carry-Save Arith-metic),改进了Viterbi算法中加-比-选单元(Add-Gmapare-Sdect Unit)的结构,消除传统行波进位加法(Ripple-CarryAdder)结构中的进位链,缩减了Viterbi译码器的关键路径,从而提高译码速度,可用在中、高速数字通信的不同应用场合中.
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| 关 键 词： | Viterbi译码器 进位保存算法 加-比-选 高速 |
Study and Implementation of a High-Speed Viterbi Decoder |
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| LI Qing,LI Xuan-zhong,JIANG Han-hong,HE Wen-hao.Study and Implementation of a High-Speed Viterbi Decoder[J].Microelectronics & Computer,2009,26(1). |
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| Authors: | LI Qing LI Xuan-zhong JIANG Han-hong HE Wen-hao |
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