| 基于FPGA的数字滤波器的设计与实现 |
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| 引用本文： | 齐海兵,刘雄飞,张德恒.基于FPGA的数字滤波器的设计与实现[J].现代电子技术,2006,29(15):70-71. |
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| 作者姓名： | 齐海兵 刘雄飞 张德恒 |
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| 作者单位： | 中南大学，中南大学，中南大学 湖南长沙410083，黄石理工学院湖北黄石435003，湖南长沙410083，湖南长沙410083 |
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| 基金项目： | 中南大学文理基金(0601053) |
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| 摘 要： | 提出了一种采用Altera公司开发的DSP Builder技术实现数字滤波器的设计方案。以一个16阶低通FIR数字滤波器,并采用状态机控制采样信号作为滤波器的输入信号,通过生成的.bsf文件设计系统的顶层电路,设计并完成了在联星科技的NC EDA 2000C实验箱上滤波器的软硬件仿真与验证。结果表明,电路工作正确可靠,能满足设计要求。
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| 关 键 词： | 数字滤波器 现场可编程门阵列 DSP Builder 状态机 |
| 文章编号： | 1004-373X（2006）15-070-02 |
| 收稿时间： | 2006-02-27 |
| 修稿时间： | 2006年2月27日 |
Design and Implementation of Digital Filter(DF) Based on FPGA |
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| QI Haibing, LIU Xiongfei ,ZHANG Deheng.Design and Implementation of Digital Filter(DF) Based on FPGA[J].Modern Electronic Technique,2006,29(15):70-71. |
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| Authors: | QI Haibing LIU Xiongfei ZHANG Deheng |
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| Affiliation: | 1. Central South University, Changsha, 410083, China; 2. Huangshi Institut e of Technology, Huangshi, 435003, China |
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| Abstract: | A design scheme which is using Altera DSP Builder to realize digital filter is proposed.Using a 16 order low pass FIR digital filter and state machine controlled sample signal as input signall.According to.bsf toplevel circuit,the filter software and hardware simulation of NCEDA2000C are realized.Results prove that the circuit is simple,credible and suitable for the design. |
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| Keywords: | digital filter FPGA DSP Builder state machine |
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