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同步时序电路故障模拟加速方法研究与实现
引用本文:刘胜利,刘蓬侠,曾芷德.同步时序电路故障模拟加速方法研究与实现[J].信息工程大学学报,2000,1(3):1-5.
作者姓名:刘胜利  刘蓬侠  曾芷德
作者单位:1. 信息工程大学信息安全学院,河南,郑州,450002
2. 国防科技大学计算机学院,湖南,长沙,410073
基金项目:国家自然科学基金资助项目(69773035)
摘    要:本文对时序电路故障模拟的一些加速技术进行了探讨,提出并实现了一个功能块级的基于测试码并行的同步时序电路故障模拟方法,对部分ISCAS89 Benchmark电路的模拟结果表明,该故障模拟方法有较好的性能.

关 键 词:故障模拟  测试码并行  单故障传播  反向追踪  无扇出区域
修稿时间:2000年6月28日

Research and Implementation of the Fault Simulation Speed-up Method for the Synchronous Sequential Circuit
LIU Sheng-li,LIU Peng-xia,ZENG Zhi-de.Research and Implementation of the Fault Simulation Speed-up Method for the Synchronous Sequential Circuit[J].Journal of Information Engineering University,2000,1(3):1-5.
Authors:LIU Sheng-li  LIU Peng-xia  ZENG Zhi-de
Affiliation:LIU Sheng li LIU Peng xia ZENG Zhi de
Abstract:Applying some speed up techniques in fault simulation of combinational circuits to sequential circuits,the paper presents and implements a parallel test pattern based fault simulation method for the synchronous sequential circuit.Experimental results on some circuits of ISCAS89 Benchmark reveal that the fault simulation method has good performance.
Keywords:fault simulation  test pattern parallelism  single fault propagation  reverse trace  fanout  free region
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