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一种用于14bit 50MHz流水线模数转换器的CMOS采样开关
引用本文:胡晓宇,周玉梅.一种用于14bit 50MHz流水线模数转换器的CMOS采样开关[J].半导体学报,2007,28(9):1488-1493.
作者姓名:胡晓宇  周玉梅
作者单位:中国科学院微电子研究所,北京,100029;中国科学院微电子研究所,北京,100029
摘    要:分析了影响CMOS采样开关性能的非理想因素,针对14bit 50MHz A/D转换器对采样开关特性的要求,提出了一种新型的时钟馈通补偿结构.该结构通过增加dummy开关管能够有效消除时钟馈通对采样值的影响,打破了开关设计中速度和精度之间的制约关系.基于SMIC 0.25μm标准CMOS数模混合工艺,采用Hspice对电路进行了模拟.模拟结果显示,在输入信号为23.3MHz正弦波,峰峰值为2V,采样时钟频率为50MHz,时钟上升/下降时间为0.1ns时,无杂散动态范围达到92dB,信噪失真比达到83dB;同时时钟馈通效应造成的保持误差由5.5mV降为90μV.这种具有时钟馈通补偿结构的采样开关特别适用于高速高分辨率模数转换器.

关 键 词:栅压自举采样开关  非线性  时钟馈通补偿  保持误差  模数转换器
文章编号:0253-4177(2007)09-1488-06
修稿时间:5/9/2007 12:00:00 AM

A CMOS Sampling Switch for 14bit 50MHz Pipelined A/D Converter
Hu Xiaoyu and Zhou Yumei.A CMOS Sampling Switch for 14bit 50MHz Pipelined A/D Converter[J].Chinese Journal of Semiconductors,2007,28(9):1488-1493.
Authors:Hu Xiaoyu and Zhou Yumei
Affiliation:Institute of Microelectronics,Chinese Academy of Sciences,Beijing 100029,China;Institute of Microelectronics,Chinese Academy of Sciences,Beijing 100029,China
Abstract:
Keywords:bootstrapped switch  nonlinear  clock feedthrough compensated  hold error  ADC
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