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一种1.5 V 8位100 MS/s电流舵D/A转换器
引用本文:朱樟明,杨银堂,刘帘曦. 一种1.5 V 8位100 MS/s电流舵D/A转换器[J]. 固体电子学研究与进展, 2006, 26(3): 394-398
作者姓名:朱樟明  杨银堂  刘帘曦
作者单位:西安电子科技大学微电子研究所,西安,710071;西安电子科技大学微电子研究所,西安,710071;西安电子科技大学微电子研究所,西安,710071
基金项目:国家自然科学基金 , 国家部委科研项目
摘    要:基于新型的低压与温度成正比(PTAT)基准源和PMOS衬底驱动低压运算放大器技术,采用分段温度计译码结构设计了一种1.5V8位100MS/s电流舵D/A转换器,工艺为TSMC0.25μm2P5MCMOS。当采样频率为100MHz,输出频率为20MHz时,SFDR为69.5dB,D/A转换器的微分非线性误差(DNL)和积分非线性误差(INL)的典型值分别为0.32LSB和0.52LSB。整个D/A转换器的版图面积为0.75mm×0.85mm,非常适合SOC的嵌入式应用。

关 键 词:数/模转换器  低压  高速  电流源  互补金属氧化物半导体
文章编号:1000-3819(2006)03-394-05
收稿时间:2005-06-08
修稿时间:2005-09-19

A 1.5 V,8 bit 100 MS/s Current-steering D/A Converter
ZHU Zhangming,YANG Yintang,LIU Lianxi. A 1.5 V,8 bit 100 MS/s Current-steering D/A Converter[J]. Research & Progress of Solid State Electronics, 2006, 26(3): 394-398
Authors:ZHU Zhangming  YANG Yintang  LIU Lianxi
Abstract:Based on the low voltage PTAT reference and PMOS bulk-driven low voltage operational amplifier, a 1.5 V 8-bit 100 MS/s segmented CMOS current-steering D/A converter in a 0.25 μm, TSMC 2P5M CMOS process is implemented. Spurious-free dynamic range(SFDR) is 69.5 dB at the 100 MS/s clock rate and the 20 MHz output frequency. The DNL of 8-bit DAC is 0.32 LSB, and INL is 0.52 LSB. The active layout area of D/A converter is about 0.75 mm×0.85 mm.The D/A converter is very suitable for SOC embedded application.
Keywords:D/A converter   low voltage    high speed    current source   CMOS
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