| PCI-Express中8b/10b编码解码器的设计与实现 |
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| 引用本文： | 许军,许西荣. PCI-Express中8b/10b编码解码器的设计与实现[J]. 微电子学与计算机, 2006, 23(3): 37-39 |
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| 作者姓名： | 许军 许西荣 |
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| 作者单位： | 航天时代电子公司第771研究所,陕西,西安,710065 |
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| 摘 要： | 文章在研究了8b/10b编码原理的基础上．采用FPGA设计并实现了PCI-Express总线控制器中的8b/10b编码解码器。8b/10b编码是一种面向字节的二进制传输代码。这种代码特别适合于高速串行总线的数据传输。这种编码编码的基本特性是保证DC平衡。采用8b/10b编码方式，可使得发送的“0”、“1”数量保持基本一致。连续的…1或“0”不超过5位，从而保证信号DC平衡。8b/10b编码器可以通过一个5b/6b编码器和一个3b/4b编码器来实现。
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| 关 键 词： | 编码 解码 |
| 文章编号： | 1000-7180(2006)03-003 |
| 收稿时间： | 2005-02-23 |
| 修稿时间： | 2005-02-23 |
Design and Implementation of an 8b/10b Encoder/Decoder for PCI-Express |
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| XU Jun,XU Xi-rong. Design and Implementation of an 8b/10b Encoder/Decoder for PCI-Express[J]. Microelectronics & Computer, 2006, 23(3): 37-39 |
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| Authors: | XU Jun XU Xi-rong |
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| Abstract: | Based on the research of the 8b/10b coding theory. The 8b/10b encoder/deceder design for PCI-Express bus controller was implemented in a FPGA. 8b/10b code is a byte-oriented binary transmission code. This code is particularly well suited for high-speed serial bus links. The 8b/10b transmission code converts a byte wide data stream of random ls and 0s into a DC balanced stream of 1s and 0s with a maximum run length of 5. The 8b/10b encoder/decoder can be accomplished by partitioning the coder into 5B/6B and 3B/4B subordinate coders. |
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| Keywords: | 8b/10b |
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