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DOI
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分类号
杂志ISSN号
An Architecture for Programmable Multi-core IP Accelerated Platform with an Advanced Application of H.264 Codec Implementation
Authors:
Yifeng Qiu
Wael Badawy
Robert Turney
Affiliation:
(1) Department of Electrical and Computer Engineering, University of Calgary, Alberta, Canada;(2) DSP Division, MVI Group, Xilinx Inc., Watertown, WI 53094, USA
Abstract:
Keywords:
H
264/AVC
Video codec
Architecture
Multi-core
Accelerator
Virtual socket
Motion estimation
DCT/Q
IDCT/Q
-1
CAVLC
Deblocking
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