| 高速MAC单元的设计 |
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| 引用本文： | 高厚新,朱光喜,屈代明,桂波. 高速MAC单元的设计[J]. 微电子技术, 2003, 31(2): 25-29 |
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| 作者姓名： | 高厚新 朱光喜 屈代明 桂波 |
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| 作者单位： | 华中科技大学电信系,湖北,武汉,430074 |
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| 摘 要： | 本文介绍一个高性能的17位乘17位加40位的乘加单元(MAC)的设计，通过将被加数作为乘法器的一个部分积参与到部分积加法阵列中来完成整个乘加运算，大幅度地提高了MAC单元的性能，在乘法器的设计中采用了改进的Booth编码技术，并且通过添加特定的部分积来避免部分积的符号位扩展和部分积产生单元中的加法操作，缩短了乘法器中关键路径的长度，最后利用HDL对设计进行描述，结合ASIC工艺库进行了综合以及资源和时延分析。
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| 关 键 词： | MAC 乘法器 部分积 改进的Booth编码 硬件描述语言 综合 |
| 文章编号： | 1008-0147(2003)02-25-05 |
| 修稿时间： | 2002-09-18 |
Design of High Speed MAC Unit |
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| GAO Hou-xin,ZHU Guang-xi,QU Dai-ming,GUI Bo. Design of High Speed MAC Unit[J]. Microelectronic Technology, 2003, 31(2): 25-29 |
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| Authors: | GAO Hou-xin ZHU Guang-xi QU Dai-ming GUI Bo |
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| Abstract: | |
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| Keywords: | MAC Multiplier Partial-Product Modified Booth encoder HDL synthesis |
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