| VHDL数据流描述模型的优化设计 |
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| 引用本文： | 邵蓉. VHDL数据流描述模型的优化设计[J]. 石油化工高等学校学报, 2005, 18(2): 76-79 |
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| 作者姓名： | 邵蓉 |
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| 作者单位： | 辽宁石油化工大学信息工程学院,辽宁,抚顺,113001 |
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| 摘 要： | 基于集成电路进行数字系统设计时,依据电路性能指标的描述,首先构造输入输出关系的真值表,建立算法模型,直接依据行为描述的真值表而设计的电路结构不明确,不利于逻辑综合;在行为域分析基础上优化设计,可得数据流描述模型,使VHDL描述模型简化,但其描述对所设计电路结构不明确,VHDL描述过程中要考虑一系列不适用于逻辑综合的约束条件的限制;门级结构域层次化优化描述模型给出明确的设计电路结构,通过描述模型对逻辑门级仿真可得到精确的电路的时序信息。
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| 关 键 词： | VHDL语言 算法模型 门级结构域描述模型 |
| 文章编号： | 1006-396X(2005)02-0076-04 |
| 修稿时间： | 2004-09-08 |
Optimum Design on Describing Model of VHDL'''' s Data Flows |
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| Shao Rong. Optimum Design on Describing Model of VHDL'''' s Data Flows[J]. Journal of Petrochemical Universities, 2005, 18(2): 76-79 |
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| Authors: | Shao Rong |
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| Affiliation: | SHAO Rong. School of Information Engineering,Liaoning University of Petroleum & Chemical Technology,Fushun Liaoning 113001,P.R. China |
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| Abstract: | |
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| Keywords: | VHDL language Behavior describe mode Gate structure levels describe model |
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